作者查詢 / bakerly
作者 bakerly 在 PTT [ Electronics ] 看板的留言(推文), 共248則
限定看板:Electronics
看板排序:
7F推: 我猜是指Reuse Methodology Manual07/23 16:30
8F推: 你的design裡有timing loop 才會有這廙warning07/08 14:47
14F推: 我覺得你的認知是對的,奇怪的是模擬結果,我跑結果是反12/17 18:05
15F→: 向慢1T。12/17 18:05
17F推: 你test bench怎麼寫,我照你寫的module key,加上我自己12/17 18:52
18F→: 的bench跑出來是反向慢1t沒錯。12/17 18:52
22F推: ncverilog12/17 22:23
6F→:我比較難想像的是memory compiler產生的rom會比合成的還大06/13 23:21
7F→:除非你的ROM size很小...要不然還沒見過比合成還大的case06/13 23:25
3F推:工作站上用nWave開吧....vi會用後其它的編輯器會看不上眼.11/05 22:36
1F→:仿真板就ICE啊...可以讓你開發程式用的..05/04 20:51
7F→:是function錯還是timing不對導致結果不對?APR tool不太可04/18 21:14
8F→:能改到你的function, 如果presim對那就應該是timing不對,04/18 21:15
9F→:這種問題STA分析應該看得出來。最笨的方法就是把FSDB打開04/18 21:15
10F→:來慢慢比找出那裡不一樣就知道錯在那裡了。04/18 21:16
2F→:1&2input看進去是gate,不是直通到output。 3.這要問助教吧03/27 12:51
6F→:如果enable是在2之後才起來的話,應該是在3do_something01/07 17:28
2F→:你先用report_analysis_coverage看看有多少path沒01/04 13:30
3F→:constrain 到吧..01/04 13:30