Re: [問題] design compiler後counter(計數器)總是 …
: 推 zxvc:之前我不太了解"at speed testing"，現在再看一次Acme大的文 08/19 22:24
: → zxvc:章終於了解問題的所在。問題在funcational mode(也就是Acme大 08/19 22:25
: → zxvc:所謂的normal (mode))，internally generated clock可能會無 08/19 22:28
: → zxvc:法產生active edge，使得接到該generated clock的flip-flop 08/19 22:29
: → zxvc:無法capture。 08/19 22:29
我這邊似乎對scan testing有些誤會。
在作stuck-at-fault scan testing會分幾個步驟：
1. scan in
2. apply primary input
3. measure primary output
4. capture
5. scan out
我之前的誤會主要是在4.的地方，
我以為到了那個步驟test mode port要調回"functional mode"才會
capture到訊號"通過functional circuit運算"的結果。
後來發現不用這麼麻煩，而且這樣作也會有我所說的generated clock無法
控制產生pulse的問題。而實際上在4.的時後，只要確保scan enable是
disable，multiplexed flip-flop就會選到"通過functional circuit運算"。
這時根本不需要去調test mode port。
那test mode port的用途為何？
它可以用來解決"uncontrollable clock"的問題。
"DFF除頻器"無法適當控制產生pulse的問題就是一種"uncontrollable clock"。
這時只要加個2-to-1 mux在那些"接除頻clock"的FFs的clock pin前就可以解決了。
這2-to-1 mux：當test mode port為"functional mode"，
就選原本functional mode的DFF除頻訊號；當test mode port為"test mode"，
就選controllable clock。
而在作scan/caputre時，用的是這controllable clock的pulse沒錯吧！？
同理transition-fault testing也同樣能用這controllable clock作
scan clock！？但transition-fault scan clock一般會比
launch/capture的週期慢，所以是不一樣的訊號，這問題要如何解決？
所以我之前猜只好用個3-to-1 mux解決launch/capture問題。
但我今天在翻TetraMAX User Guide時，才知道ATE似乎是可以在
一個scan clock中把一些cycles插pulse作launch/capture。
Tetra MAX[1] p.p. 17-8 "Creating Transition Fault Waveform Tables"
就有教如何寫這種protocol：
WaveformTable "_default_WFT_" {
Period '100ns';
Waveforms {
略
"Pixel_Clk" {P {'0ns' D; '45ns' U; '55ns' D; } }
}
}
WaveformTable "_fast_WFT_" {
Period ’20ns';
Waveforms {
略
"Pixel_Clk" {P {'0ns' D; '9ns' U; '11ns' D; } }
}
}
至於這種波形是如何產生的，其中一種方法是"dynamic cycle-time switching"，
另一種是用mux - "MUXCLOCK"[1] p.p. 17-15~17-16。
MUXCLOCK其實是用OR gate接到scan clock與另一ATE產生的pulse，
這似乎與我說用3-to-1 mux有異曲同工之妙。
所以Acme大所說的at-speed testing似乎也不是個問題！？
References:
[1] Synopsys, "TetraMAX ATPG User Guide Version C-2009.06," June 2009.
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法滅盡經：
http://www.cbeta.org/result/normal/T12/0396_001.htm
共勉之。
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