作者 satokuzao 在 PTT [ Electronics ] 看板的留言(推文), 共48則

[問題] B類輸出級的輸入限制

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作者: satokuzao - 發表於 2013/07/28 12:08(10年前)

6^F→satokuzao:沒錯!想想也只能這樣.不過現實中因為base端再過去一定還07/29 23:28

[問題] hspice如何處理製程檔

[ Electronics ]50 留言, 推噓總分: +8

作者: acespeed - 發表於 2013/07/16 01:14(10年前)

49^F→satokuzao:當年第一次AIC傻傻地拿model去跑模擬算kn'和kp'07/24 23:27

[問題] Dummy MOS 接法討論

[ Electronics ]4 留言, 推噓總分: +3

作者: satokuzao - 發表於 2012/02/02 11:22(12年前)

3^F→satokuzao:其實我知道ㄟ!但更想知道問題的討論XD02/02 12:22

[問題] 類比IC設計

[ Electronics ]11 留言, 推噓總分: +3

作者: z1230456987 - 發表於 2012/01/08 17:03(12年前)

5^F→satokuzao:系上教授：精通數位需要3年，類比需要8年。01/09 14:18

7^F→satokuzao:光想想養成計畫要八年就真的會猶豫要不要走類比IC~何況01/09 14:44

8^F→satokuzao:還有"對岸的人海"，去看看EETOP的投票就知道。最慘的情01/09 14:45

9^F→satokuzao:況應該就是"養成失敗"或者對岸崛起01/09 14:45

Re: [問題] Cascode輸出模擬時,BODY出現大量電流?

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作者: satokuzao - 發表於 2012/01/05 13:53(12年前)

1^F→satokuzao:先謝謝各位!剩下十多天專題整個重做~希望有機會交出來01/09 14:49

[問題] Cascode輸出模擬時,BODY出現大量電流?

[ Electronics ]4 留言, 推噓總分: +2

作者: satokuzao - 發表於 2012/01/05 11:29(12年前)

1^F→satokuzao:這是TSMC 0.18um 製程,圖片是用3.3V的MOS01/05 11:30

4^F→satokuzao:對!有3.3V的,model加進來就可使用01/09 14:48

[問題] 嘿!新年快樂~start-up模擬小問題

[ Electronics ]4 留言, 推噓總分: +1

作者: satokuzao - 發表於 2011/12/31 17:35(12年前)

3^F→satokuzao:舉個例子,像是BMP這種基本的電路就故意將Pmos Gate=001/02 06:22

4^F→satokuzao:打錯~Pmos Gate=VDD Nmos Gate=0 故意讓電流=0再跑TRan01/02 06:23

Re: [討論] 救命!PVT模擬到快瘋了

[ Electronics ]5 留言, 推噓總分: +1

作者: satokuzao - 發表於 2011/12/20 02:20(12年前)

1^F→satokuzao:這篇只是偏壓電路的分析而已，至於load regulation差的12/20 02:27

2^F→satokuzao:因明天會再附上，但不得不佩服,原因版眾說的是對的12/20 02:27

4^F→satokuzao:版主還沒睡啊~可是我這邊圖開起來很正常ㄟ~研究一下12/20 04:59

Re: [討論] 救命!PVT模擬到快瘋了

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作者: satokuzao - 發表於 2011/12/18 16:14(12年前)

29^F→satokuzao:看樣子就真的是gain不足的問題了!實際上這樣的gain只有12/19 21:21

30^F→satokuzao:只有60dB因為所有支路加起來只吃8uA為了靜態電流考量12/19 21:22

Re: [討論] 救命!PVT模擬到快瘋了

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作者: satokuzao - 發表於 2011/12/18 03:47(12年前)

4^F→satokuzao:.18製程沒錯! cascode 是因為這樣保證讓整個穩壓器的主12/18 15:19

5^F→satokuzao:極點在OTA和POWER MOS之間,因為一般有外掛電容的穩壓器12/18 15:19

6^F→satokuzao:主極點在Vout那邊,由外掛電容和其ESR和輸出電阻的組成12/18 15:20

7^F→satokuzao:TO jamtu:是由模擬來的，非外掛。好吧，說實話,我不知道12/18 15:22

9^F→satokuzao:我說的V_offset是不是就是Vos_s,Vos_s在Martin那本是說12/18 15:23

10^F→satokuzao:system offset,指的是輸入兩端的誤差,所以我才決定量測12/18 15:24

11^F→satokuzao:輸入兩端的數據12/18 15:24

14^F→satokuzao:喔!其實並不是沒掛啦~Capcitor-Less其實就是把外掛電容12/18 16:17

15^F→satokuzao:做到晶片裡面,我PO的圖也有,是掛100pF而已.這種LDO的特12/18 16:18

16^F→satokuzao:色就是暫態表現不好,因為只有100pF.不像一般至少都有1u12/18 16:18

27^F→satokuzao:偏壓電路分析已經附上請賞光12/20 02:31

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