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作者 mmonkeyboyy 在 PTT [ Electronics ] 看板的留言(推文), 共3896則

限定看板：Electronics

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[問題] 一個有問題的電路

[ Electronics ]22 留言, 推噓總分: +2

作者: FableKevinS - 發表於 2012/10/09 01:03(13年前)

15^F推mmonkeyboyy:電流太高你橋式完之後的電壓是多少@@"10/09 21:14

16^F→mmonkeyboyy:如果是load太小買個大電阻放上去唄10/09 21:15

[問題] 送電為什麼要高電壓(已解決^.^)

[ Electronics ]48 留言, 推噓總分: +12

作者: twpunkboy - 發表於 2012/10/08 22:48(13年前)

45^F推mmonkeyboyy:同學修一下power system吧10/09 21:11

46^F→mmonkeyboyy:線多長R就多少少一點電流功耗就少成本決定!!10/09 21:12

[問題] 請推薦半導體製程用書

[ Electronics ]9 留言, 推噓總分: +3

作者: ztop - 發表於 2012/10/08 00:58(13年前)

1^F推mmonkeyboyy:新就不知道了舊的有蕭宏&wolf10/08 11:16

5^F推mmonkeyboyy:Silicon Processing for the VLSI Era10/09 02:02

6^F推mmonkeyboyy:Introduction to Semiconductor Manufacturing10/09 02:04

7^F→mmonkeyboyy:Technology 我不太相信這兩本書找不到10/09 02:05

8^F→mmonkeyboyy:施敏的我就不知道了我只有看過沒仔細覺得好壞10/09 02:05

Re: [問題] verilog array index表示的限制

[ Electronics ]4 留言, 推噓總分: +2

作者: zxvc - 發表於 2012/10/06 17:06(13年前)

3^F推mmonkeyboyy:4D IC 要看你花多少錢買到的 FPGA 到是 TABULA說10/06 20:34

4^F→mmonkeyboyy:說他們的東西叫TIME machine 看看就好 XD10/06 20:35

[問題] MUX兩種Verilog寫法的差異

[ Electronics ]40 留言, 推噓總分: +7

作者: simcityjerry - 發表於 2012/09/29 19:29(13年前)

27^F推mmonkeyboyy:一個是有一個動就動一個是只有動EN才動10/01 22:02

28^F→mmonkeyboyy:差別在要多用幾個DFF10/01 22:03

29^F→mmonkeyboyy:a<=b signal flow, a=b variable flow10/01 22:04

30^F→mmonkeyboyy:在verilog裡是不管的但在VHDL裡有差10/01 22:05

31^F→mmonkeyboyy:<= real connection = register copy10/01 22:07

34^F推mmonkeyboyy:那我就想問了 LATCH電路在FPGA上怎麼實現呢10/03 22:42

35^F推mmonkeyboyy:你講的是沒有錯但前題是不能用LATCH10/03 22:44

36^F推mmonkeyboyy:alway could be combinational logic10/03 22:46

37^F推mmonkeyboyy:我這說的是不全正確沒錯10/03 22:50

[問題] 波德圖的波形

[ Electronics ]21 留言, 推噓總分: +6

作者: tyc5116 - 發表於 2012/09/27 21:55(13年前)

18^F推mmonkeyboyy:FTL09/28 20:56

19^F→mmonkeyboyy:推錯篇sorry09/28 20:57

[請益] 學習NAND Flash控制IC韌體

[ Electronics ]4 留言, 推噓總分: +1

作者: ray0129 - 發表於 2012/09/27 16:04(13年前)

4^F→mmonkeyboyy:都了解一下吧包含FTL部份09/28 21:06

Re: [問題] ADC的線性度調整問題

[ Electronics ]16 留言, 推噓總分: +6

作者: jamtu - 發表於 2012/09/14 23:04(13年前)

14^F推mmonkeyboyy:推 trial and error09/15 23:44

Re: [問題] verilog中if else和case合成後的差別

[ Electronics ]8 留言, 推噓總分: +1

作者: Pash77 - 發表於 2012/09/13 16:26(13年前)

1^F推mmonkeyboyy:簡單明瞭電路複雜一樣有問題的 XD09/13 21:37

2^F→mmonkeyboyy:Compiler 是以6~8 bits的表去查的沒錯09/13 21:37

3^F→mmonkeyboyy:5 bits 的會被合併 (如果夠聰明的話)09/13 21:38

4^F→mmonkeyboyy:現在較新的hdl 寫法都慢慢推行parallel寫法09/13 21:38

5^F→mmonkeyboyy:以及相對聰明的compiler 因為大家慢慢發現compiler實09/13 21:39

6^F→mmonkeyboyy:在是有一些難解之處更多的是使用者寫法的問題09/13 21:39

7^F→mmonkeyboyy:case to case study之後你會發現有些公司提供的轉譯09/13 21:40

8^F→mmonkeyboyy:庫可以幫助一些優化但進步也有看情況了 XD09/13 21:40

[問題] analog design enviroment library 設定

[ Electronics ]9 留言, 推噓總分: +3

作者: ceaserman - 發表於 2012/09/09 21:18(13年前)

9^F推mmonkeyboyy:cadence enviroment setting那裡要改就好了09/11 02:59

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