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作者 jnlien 在 PTT 全部看板的留言(推文), 共253則
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4F推:要去算一下Cp寄生值 Cp會降低OP的gain 造成static error07/25 22:26
5F→:雖然模擬中會有上述效應 但下線後通常Cp更大 會更嚴重07/25 22:27
6F→:resolution需求低(<10b)時 1樓的2.會蠻小的 通常是看1.07/25 22:28
1F推:rail-to-rail 不過不是外掛 是input架構小變化07/24 23:02
5F推:科科 如果有查到其它的分享一下吧 我也蠻想知道的~07/24 23:28
48F推:打線烙塞沒辦法 人家沒叫好人上就能贏了123.192.85.113 07/11 20:31
50F→:下次加油123.192.85.113 07/11 20:31
63F推:航母象好威123.192.85.113 07/11 20:36
9F推:要小心 找到爛的=笨蛋 找到好的=沒品123.192.68.66 06/05 23:12
18F推:達比應該一個熊隊的錢都請不動123.192.68.66 06/05 23:15
31F推:我喜歡熊隊 但是落後就罵人 輸掉就酸人123.192.68.66 06/05 23:36
32F→:真的很難以認同123.192.68.66 06/05 23:36
34F→:不管是教練還是球迷 都有改進空間123.192.68.66 06/05 23:36
35F→:yes~ 希望下一場不要糗掉123.192.68.66 06/05 23:37
40F推:yes 我錯了@@ 輸了獅迷的格調123.192.68.66 06/05 23:42
3F推:我也是現在看到才知 好威阿!12/26 23:28
1F推:推 前半部就是"read stability" 後半部則是"writeability"11/22 10:55
2F推:smith裡說access要大於latch的nmos 這樣的結論和這篇不同11/22 10:59
3F→:這是因為smith read時是把bitline先拉到Vdd/2 而非Vdd11/22 10:59
4F→:所以smith的電路比較不會有read stability的問題11/22 10:59
18F推:推這篇原po smith的電路算是介紹初學者入門 如果要知道更詳11/22 21:22
19F→:細 可以參考VLSI相關書籍11/22 21:22
1F推:9e-9 = 9 x 10^-911/18 15:43
4F推:spice大小寫好像都是一樣的11/18 18:59
7F推:大推 這篇作者很有料 另外建議樓上去找一些比較基本的11/18 11:32
8F→:flash ADC design technique 像是interpolation就很重要11/18 11:33
15F推:op消失的原因可能是跟製程一直進步有關吧~ 現在製程進步的11/18 12:09
16F→:方向對OP的設計相當不利 尤其是Vdd的降低11/18 12:09
25F推:請問樓上方便回文說明嗎? 以前這邊就一直弄不太懂@@11/18 23:31
26F→:總覺得2-stage的slew rate 不只I5/Cc那麼單純 但不知詳情11/18 23:32
27F→:感恩~11/18 23:32
1F推:指得是RC串聯嗎? 其實圖應該就是C的壓差反過來11/18 00:59
2F→:Vr = VDD - Vc11/18 01:00
2F推:flash的比較器應該是希望output可以rail-to-rail 雖然op有11/17 23:16
3F→:超高的open-loop gain可以達到這樣的功能 但op不是為了這個11/17 23:17
4F→:目的而使用 對op有利的操作是閉迴路時穩定的特性11/17 23:18
5F→:1樓的dynamic comparator是正解 small-area low-pwer11/17 23:18
6F→:是目前最標準的主流 但是使用這個電路要解決的問題也頗多11/17 23:19
7F→:flash ADC領域的相關文獻大多是在解決這樣的問題11/17 23:19