[問題] 分數PLL SDM noise model 問題

看板Electronics作者 (gg)時間11年前 (2014/05/02 23:49), 編輯推噓8(8推 0噓 25→)
留言33則, 5人參與, 最新討論串1/3 (看更多)
大家好,小弟目前在估分數PLL的output noise,sigma delta modulator這塊比較 不清楚,參考了很多paper,看到楊育哲博士的論文: CMOS單晶片分數型鎖相迴路頻率合成器之設計與應用 裡面有提到,但不知道我看不懂還是講不夠清楚,裡面有整個PLL的NTF,如下圖: http://ppt.cc/kvfV 內文有提到quantization noise 需要積分然後可以丟進去SDM對PLL的NFT方可得 SDM對於PLL的noise,可以跑出下面的圖: http://ppt.cc/ZyX~ 但我不知道如何跑出quantization noise以及如何去積分他 本論文的附錄裡面有推導SDM所產生的noise,如下公式: http://ppt.cc/s6Po 於是我把它鍵入matlab,然後再套入低通,跑出來的圖如下: http://ppt.cc/zP8Y (黑色是經過低通的noise,藍色是上公式所產生的) 但跑出來的圖與論文的差很多,sdm noise有過高,有點不太對,想請問一般如何 model sdm對於pll的noise,謝謝!!! -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 114.37.172.161 ※ 文章網址: http://www.ptt.cc/bbs/Electronics/M.1399045771.A.7AB.html
推
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為什麼我覺得這篇求教文沒甚麼誠意的感覺壓
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你有先搞清楚sdm noise在PLL裡面到底應該長甚麼樣嗎?
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將雜訊推到高頻，在低通濾波
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noise shaping
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請問哪裡沒誠意，是不是在這裡發文要給你們幾位大大鑑定有沒
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有誠意才能發文阿XD
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推
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一樓可能表達比較激動一點　不過我從你的問法　
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同樣認為你應該不懂DSM noise
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你先練習用matlab正確跑出一個1st order DSM的output FFT
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才能談更多事情
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這樣你才能解釋2F:搞清楚SDM noise在PLL長啥樣
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推
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注意　不是像你最後兩張圖寫s-domain的function
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是真的對time domain做FFT　不要搞錯了
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推
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delta-sigma modulation是一個非線性控制系統
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出來的NTF不會是理想的曲線~"~
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謝謝death大，想請問您會如何模擬整個pll的noise包含sdm，回
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樓上，我當然有把sdm兜出來，用verilog寫三階的，也跑fft了
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，但跑出來會是雜訊毛毛的樣子，請問你們要如何跟其他電路
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的noise加在一起？其他的電路是用pss跟pnoise，是一個點對上
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一個值，sdm跑出來是隨機的，請問要如何加起來？所以我問大
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家是不是會利用公式估計sdm noise,再與其他電路一起加總，
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我想你們懂sdm,但你們有跑過pll noise嗎？？
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推
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when we use sdm/dsm, we can "no longer only rely
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on linear transformation analysis."
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to analysis a system comprising "non-LTI" factor(s
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one should analyze the system with transient
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推
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it recites: delta-sigma fractional-n dividers
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overcome this problem by randomizing the selection
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of n and (n + 1), while maintaining the time-avera
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推
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沒誠意的文但是可以把電資版三本柱jod都釣出來了
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以後小弟發問還是不要有誠意好了XDDD
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推
05/07 09:48, , 33F
釣出來沒有用啊，因為離真正解決問題還很遠~"~
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文章代碼(AID): #1JOxwBUh (Electronics)
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