[問題] verilog語法問題

看板Electronics作者 (......)時間17年前 (2007/06/03 19:57), 編輯推噓3(3推 0噓 4→)
留言7則, 3人參與, 最新討論串1/7 (看更多)
請問一下 若是宣告一個array 像這樣 reg[31:0] block[7:0] 如果我想拿其中一個block的其中一段bit出來做運算 例如第2個block的[31:20]這一段 我應該怎嚜寫呢? 應該不能用兩個[]吧? 印象中這樣應該是錯的 而 block[2] 這樣寫的話代表的應該是32bits....是嗎...? -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 140.112.244.88
推
06/03 20:08, , 1F
先放到一個reg再拿出來
06/03 20:08, 1F
推
06/03 20:08, , 2F
你這樣寫是MEM的寫法，所以無法直接單獨抓出第2個block
06/03 20:08, 2F
→
06/03 20:10, , 3F
的[31:20]這一段ꄠ
06/03 20:10, 3F
→
06/03 20:11, , 4F
你可以用wire接出這一個word再讀出所要的bit區段
06/03 20:11, 4F
→
06/03 20:13, , 5F
但這樣寫合成效果不好，一般不建議這麼做
06/03 20:13, 5F
推
06/03 20:14, , 6F
那請問還有其他方法嗎? 我只是想判斷讀進來的值有沒有
06/03 20:14, 6F
→
06/03 20:15, , 7F
跟mem中某一word的某一個bit區段是不是相等而已@@"
06/03 20:15, 7F
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