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作者 wildwolf 在 PTT [ comm_and_RF ] 看板的留言(推文), 共273則
限定看板:comm_and_RF
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1F→: 連寫學術文章都會被批評工廠雜音那麼多140.123.101.43 05/05 12:48
2F→: ,判斷準確度超級差的。不如裝加速度計140.123.101.43 05/05 12:49
3F→: ,如果不管成本的話。140.123.101.43 05/05 12:49
1F→: .sv 是 SystemVerilog 的模型, .v 是140.123.101.43 02/25 12:49
2F→: Verilog140.123.101.43 02/25 12:49
3F→: 用文字編輯器開啟看啊140.123.101.43 02/25 12:50
1F推: 第七版出來了喔140.123.101.43 02/24 21:50
1F→: 你有點倒果為因,應該是 VBE 上升導致140.123.101.43 04/26 08:58
2F→: IC 上升,IC 上升導致 recombine 變多140.123.101.43 04/26 08:59
3F→: 然後,IB是用來補被recombine的hole,所140.123.101.43 04/26 08:59
4F→: 以增加。怎麼會反過來從 IB 上升討論 IC140.123.101.43 04/26 09:00
5F→: 也跟著上升呢?140.123.101.43 04/26 09:00
1F推: 你不如直接PC接數據機,測一下源頭大水1.175.138.128 04/15 06:25
2F→: 管速度吧1.175.138.128 04/15 06:25
3F推: 1Gbps 這是連線模式,不代表真實傳輸率1.175.138.128 04/15 06:26
1F推: reference lib 不要寫 sample220.143.163.150 12/12 20:49
1F→: 直徑140.123.101.43 11/11 11:52
3F→: 連製作的步驟也很類似喔,灑料,烤箱,140.123.101.43 11/13 16:52
4F→: 切割封裝140.123.101.43 11/13 16:53
1F→: 就 PLL + DLL 啊140.123.101.43 10/15 19:30
1F推:right hand side?42.76.140.148 07/20 19:32
1F→:你把那個m(t)想成m(t)=sin(t)就會懂了140.123.101.43 06/13 12:53