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作者 wildwolf 在 PTT [ comm_and_RF ] 看板的留言(推文), 共273則
限定看板:comm_and_RF
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1F→:工數、DSP、數位通訊、IC設計相關課程140.113.212.9 07/18 13:10
1F→:fwrite(s, UART_CMD , 'uchar','sync');140.113.212.9 06/11 17:48
4F→:原PO自己都講了,頻率會飄掉,這部分的問140.113.212.31 05/24 07:27
5F→:題原PO打算怎麼解決?留給Baseband處理140.113.212.31 05/24 07:28
6F→:? Baseband 能容許的 CFO 也是有範圍的140.113.212.31 05/24 07:29
1F→:Gate Induced Drain Leakage140.113.212.9 05/17 20:46
6F→:我覺得原PO沒搞懂,一般公司,專利發明140.113.212.9 05/07 08:25
7F→:出來是屬於公司的,公司只會賞個五萬給你140.113.212.9 05/07 08:26
8F→:吃紅,不可能把專利的獲益跟你分享。140.113.212.9 05/07 08:26
1F→:教科書都有 http://0rz.tw/6b3Vd140.113.212.9 04/07 10:39
1F→:stack ? stable ?140.113.212.9 04/03 11:41
2F→:樓上,那跟原PO問的無關140.113.212.31 04/02 05:51
3F→:給原PO,有些功能不一定有好壞之分,純粹140.113.212.31 04/02 05:52
4F→:只是有客戶要這個功能,廠商就提供。140.113.212.31 04/02 05:52
8F→:metal slot rule 只跟寬度有關140.113.212.9 04/09 10:57
1F→:先講結論,內建的比較悲觀保守140.113.212.31 03/27 06:50
2F→:QRC or Fire&Ice 抽出的結果比較接近真實140.113.212.31 03/27 06:50
3F→:Timing Optimization 一般還是用內建140.113.212.31 03/27 06:51
4F→:一般來講不至於有非常大的差異,但是還是140.113.212.31 03/27 06:55
5F→:小差異。140.113.212.31 03/27 06:56
6F→:只是對一些 timing critical design 而言140.113.212.31 03/27 06:57
7F→:這個小差異可能很重要140.113.212.31 03/27 06:58
8F→:但是即使是Fire&Ice, Accuracy 也只能做140.113.212.31 03/27 07:17
9F→:90% net 的誤差 < +-15%,內建的更糟140.113.212.31 03/27 07:19
10F→:所以如果你有把best/worst case 放入APR140.113.212.31 03/27 07:21
11F→:考量,應該是不用太擔心出來在TT不會動。140.113.212.31 03/27 07:22
1F→:如果多個 model 放在同一個 .l 檔中,你140.113.212.31 03/27 07:23
2F→:得要寫多行 .lib 敘述去呼叫不同的device140.113.212.31 03/27 07:24
3F→:model 進來。或者是真的有RPO2這個model?140.113.212.31 03/27 07:25