[問題]mix-signal design layout 驗證

看板Electronics作者時間12年前 (2013/04/18 22:43), 編輯推噓4(4推 0噓 8→)
留言12則, 5人參與, 最新討論串1/2 (看更多)
各位大大們 小弟最近在跑混合訊號設計的後段設計 遇到了問題 我將數位電路的部分利用ICC產生GDS也驗證LVS過了 但是為了將數位類比兩邊的layout畫在一起 把GDS Import到virtuoso後 對類比layout拉線也拉完了 一起跑lvs時卻發現數位電路cell-base部分都沒辦法找到instances 想請教各位經驗豐富的前輩們該如何解決 -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 118.169.239.131
推
04/18 23:18, , 1F
根據我拉拉米的經驗,你若是用數位gds匯入類比做最後處理
04/18 23:18, 1F
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04/18 23:19, , 2F
建議你把數位寫成一個black box 只要定義他的input/output
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04/18 23:19, , 3F
跟類比一起跑LVS就會過了,你若沒這樣做,calibre看不懂數位
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04/18 23:20, , 4F
的部分,這樣是跑不過的
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推
04/18 23:24, , 5F
前提是你走cell-based路線 已經確認你數位LVS沒問題
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04/18 23:31, , 6F
感謝您 我再努力試看看
04/18 23:31, 6F
推
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若是CIC的話你走大A小D要把普通再跑full-custom的lvs檔
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04/19 00:06, , 8F
後面補上你APR後認lvs的command line，這樣才能認出數位
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04/19 00:07, , 9F
的cell-box
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推
04/19 01:49, , 10F
一樓多個i 比較潮
04/19 01:49, 10F
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08/13 19:38, , 11F
的cell-box https://muxiv.com
08/13 19:38, 11F
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09/17 23:31, , 12F
跟類比一起跑LVS就會 https://daxiv.com
09/17 23:31, 12F
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文章代碼(AID): #1HS0Qf5T (Electronics)
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