作者 wildwolf 在 PTT [ Electronics ] 看板的留言(推文), 共96則

[ Electronics ]17 留言, 推噓總分: +9

作者: g1990822 - 發表於 2020/10/16 04:27(3年前)

1^F→wildwolf: https://reurl.cc/Kj9d3M10/16 09:24

[ Electronics ]12 留言, 推噓總分: +4

作者: jqk147258369 - 發表於 2020/05/08 03:45(4年前)

2^F→wildwolf: google 一下 pulse latch，它的 hold time > setup time05/08 09:07

3^F→wildwolf: 一般 DFF， setup time > hold time requirement05/08 09:08

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作者: hinoapple - 發表於 2020/04/24 09:00(4年前)

1^F→wildwolf: 就是讓輸出頻率不維持固定輸出，規律的在一個範圍內變化04/24 10:57

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作者: camry2009 - 發表於 2020/04/13 11:10(4年前)

1^F→wildwolf: 輸入電源沒給，也沒做直流分析，直接print是要看甚麼04/13 13:07

[ Electronics ]4 留言, 推噓總分: +4

作者: kelvin800514 - 發表於 2020/02/07 17:14(4年前)

3^F推wildwolf: 找一下 measure 的 find 應該可以用02/08 07:03

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作者: sshc - 發表於 2020/01/09 20:03(4年前)

1^F→wildwolf: 提醒一下 $ 是註解01/10 08:06

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作者: lolwow12333 - 發表於 2019/12/17 14:55(4年前)

1^F→wildwolf: 看起來像是 behavior 模擬沒有先把 timing check 關掉12/17 16:16

2^F→wildwolf: +notimingcheck12/17 19:49

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作者: gmotwm2001 - 發表於 2019/11/07 12:00(4年前)

2^F→wildwolf: 你直接 lmstat -c 5280@lsncku 不要加路徑就可以了11/07 13:34

5^F→wildwolf: which lmstat 有看到程式，就可以，沒看到就是路徑沒設11/07 19:06

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作者: yoche2000 - 發表於 2019/10/28 23:37(4年前)

7^F→wildwolf: 在台灣工作就學Verilog10/30 08:42

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作者: paul09253336 - 發表於 2019/08/25 15:41(4年前)

1^F推wildwolf: 就分成兩個 pin，不要用 inout 啊08/25 17:08

5^F→wildwolf: 節省 I/O pin 並不代表你的內部要用 inout ping 啊08/26 12:40

6^F→wildwolf: 你可以用有 input and output 的 I/O pad, 但是讓內部所08/26 12:41

7^F→wildwolf: 有 module 都不需要 inout pin08/26 12:41

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