作者查詢 / tim82518
作者 tim82518 在 PTT [ Electronics ] 看板的留言(推文), 共36則
限定看板:Electronics
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2F推: R4R5R7是為了相加吧?試著縮小?但不要一下子太小,怕燒02/18 01:07
3F→: 。02/18 01:07
4F推: 這三個也會貢獻source impedance 所以可能輸出瓦數是02/19 11:56
5F→: 被他限制住的,注意你的loop 終點是在那三個電阻前。02/19 11:56
1F→: 建議確認1. 掐住 pass gate 的那個nch 是否有確實關閉…09/26 21:47
2F→: 2. 拔掉 OCP 電路 ldo依然穩定…09/26 21:47
3F→: 還有OCP loop 不再 ldo EA, bench 應為load 短到地,斷09/26 21:51
4F→: 點在掐住 pass gate 的那顆 nch 的 gate ,另外好奇,是09/26 21:51
5F→: 什麼應用要這麼精準的 OCP... 需要用到op 來鎖 replic09/26 21:51
6F→: a 的電流09/26 21:51
7F推: 我的看法: 1. 在沒有 oc 行為時,ocp loop 應該要完全09/27 09:53
8F→: 關閉,故我認為 nch 需要關到夠小,可能會留一點 Iq 但09/27 09:53
9F→: 不應影響到 ldo loop09/27 09:53
10F→: 3. 這樣看只會看到 ldo loop ,還是你是說 OCP 的那個 E09/27 09:55
11F→: A ? 要注意你的loop 有兩個,兩個各有自己形成的條件09/27 09:55
12F→: 與 穩定度09/27 09:55
13F推: 4. 不太明白其中會造成震盪的路徑,不過應注意 OCP thre09/27 09:59
14F→: shold 與 Iq 不要太近,另外從成本考量,如果只是單純限09/27 09:59
15F→: 制啟動inrush current 就要加一顆op 的話是不是有點浪費09/27 09:59
16F→: silicon XD09/27 09:59
17F→: 歐抱歉,我指得是vocP 那個 沒注意到你的 pass gate09/27 17:20
18F→: 不是直接摸到EA....09/27 17:20
6F推: 在 latch 與 nch 中間插入限壓用的HV MOS,後面 inverte09/09 17:47
7F→: r domain 設定在 vdd~vdd-5 即可09/09 17:47
4F→: Google 第一頁就有paper惹…08/15 11:44
1F推: 那是 subthrehold10/31 01:07
5F推: 不一定,可能是 above threshold 也可能是 sub-threshol10/31 11:19
6F→: d ,這看你的偏壓設計在哪10/31 11:19
9F推: 噢澄清一下,我上面回文是針對ha的 question10/31 14:15
10F→: 另外我的認知上spice 不分cutoff and subthrehold10/31 14:15
11F→: cadence似乎有,久沒用了有錯請指正10/31 14:15
2F推: transimpedance 不也需要電阻,還是我孤陋寡聞請指教 :)10/30 16:58
3F→: 當然也可以是mos r 但就要花力氣處理線性度的問題,感覺10/30 16:58
4F→: 不容易呢…10/30 16:58
12F推: 取樣頻與low pass corner 的關係可Google Nyquist theor10/30 16:47
13F→: y:)10/30 16:47
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