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作者 poib 在 PTT [ Electronics ] 看板的留言(推文), 共9則

限定看板：Electronics

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[ Electronics ]11 留言, 推噓總分: +1

作者: JFAVA - 發表於 2015/01/27 23:23(11年前)

4^F→poib: 圖示不大清楚若第2,3欄分別是up,dn訊號那PFD有deadzone存01/28 20:20

5^F→poib: 在建議先解決比較好釐清問題前圖鎖得漂亮也可能因而是假象01/28 20:23

6^F→poib: 另外從後圖來看鎖定後充電路徑似有漏電無UP卻可維持Vtune?01/28 20:48

9^F→poib: 不需換架構在pfd reset path加上delay即可上圖看起來仍不01/29 17:25

10^F→poib: 足理想狀態是鎖定後up/dn皆產生同寬pulse 寬度恰足以打開CP01/29 17:28

[ Electronics ]44 留言, 推噓總分: +5

作者: tjyee - 發表於 2013/10/15 17:37(12年前)

1^F→poib:可行會多了一個很遠的pole 加太大會影響穩定度10/15 18:23

20^F推poib:加入電容目的在對delay cell的VDD做濾波等同於在vctl與delay10/16 11:09

21^F→poib:cell的VDD中間插入一LPF(pole)且這個pole是在loop裡面的類似10/16 11:10

22^F→poib:在二階的filter後面串接一組電阻電容變成三階的filter10/16 11:12

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