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作者 daroke 在 PTT [ Electronics ] 看板的留言(推文), 共41則
限定看板:Electronics
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2F推: 怎麼接都表達不清楚..drain接什麼 第一第二級中間接什麼07/02 01:41
3F→: 確定是inverter? 會不會是當transmission gate用?07/02 01:42
7F推: 每次焊完上錫在焊頭,等老化再用還原劑,可以多撐很久06/09 14:43
4F推: 電機很廣 你最好直接問那些youtuber該學啥05/16 18:43
5F→: 看起來你說的有些也偏資工或機械了05/16 18:44
4F推: XY各加一個swithc初始到地然後斷開看看05/06 23:35
2F推: 這是數位最大RC估算吧 右邊9左邊就604/25 20:45
3F推: 任一個情況下要小於等於R04/25 20:48
8F推: 實際跑模擬並且用alpha law來得到較準的參數04/18 14:06
9F推: 也只是略準 實際可能會用到subthreshold region04/18 14:08
6F推: 正輸入如果卡5.91V表示負輸入電壓高過5.91V才對03/30 19:17
7F→: 你的接法看起來正輸入要在5.91V跟6.09V來回震盪03/30 19:19
8F→: waveform gen.是VG1嗎? 測電壓用碳棒有可能loading effect03/30 19:22
9F→: 如前幾樓說的03/30 19:22
1F→: 走的線類型不同吧 cable tray通常走比較大的纜線03/24 18:13
10F推: 你貼的圖1: 因為virtual ground. Rid近似為r(pi)吧03/19 13:40
11F→: 你貼的圖2: 多個RE Rid應該近似為r(pi)+(1+beta)RE03/19 13:41
12F→: 圖2應該要考慮ro, 但一般來說ro很大並聯後會忽略03/19 13:42
13F→: 有錯再麻煩指正 話說現在還會學BJT嗎?03/19 13:43
15F推: 當不同R order有差時才會省略做近似03/20 09:03
16F推: 做degeneration 的RE太大電路就沒gain了03/20 09:06
17F推: 另外REE是只在Ricm才看得到, 因為此時沒有virtual ground,03/20 09:12
18F→: 就要看REE大小判斷能不能忽略ro03/20 09:12
19F推: 我是建議不要背那些,全都不要省略自己多推導幾次以後遇03/20 09:18
20F→: 到不同的電路就能舉一反三03/20 09:18
21F→: 我沒看過那本書, 如果你也能自己推導出結果那就沒問題吧03/21 17:07
1F→: 非專業回答 資訊不太足 1.換了會改善 2.3.都不必要03/02 09:48
2F→: 能融焊錫應該沒問題 有確認是否PCB太大片導致不易加熱嗎?03/02 09:50
3F→: 解焊老錫把焊槍接觸時間拉長 如不行再搭配吸錫線試試看03/02 09:52