Re: [請益] CDR 各種問題 文長請耐心觀看

看板comm_and_RF作者 (周大俠)時間6年前 (2017/07/31 03:34), 編輯推噓5(5推 0噓 42→)
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請問Xeaper大，PD在transfer中不就是做相位相減的動作嗎?，請問兩者的不同如何在 transfer function中表示呢?有任何文獻可以參考嗎?我是用BBPD，jitter transfer中 直接以Icp/2/pi表示PD的增益，之前有看過JLee發表的modeling of bang bang CDR ，裡面 提到超過BBPD的線性區會有slewing的現象，請問您指的是這個嗎? -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 140.114.108.172 ※ 文章網址: https://www.ptt.cc/bbs/comm_and_RF/M.1501443267.A.A0A.html
推
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bbpd的線性區跟系統noise會有關，而且這
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區間應該不大，當你在測jtl極限時，你打
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的sj amp早已超過線性區，因此bbpd會發生s
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lewing, 因此用非線性分析比較合乎常理
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推
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bbpd 的jtf跟linear pd之所以不同是因為
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當sj打的頻率越高時，bbpd會發生slewing，
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因此這時候bbcdr所反映出來的jtf bw跟sj a
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mp有關，因此你很難參照jtf去設計bbcdr,
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除非規格內有定義jtf的測試是在 sj amp固
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定的情況下進行，像是sata就有定義sj amp,
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但沒關係同常serdesrx端比較多看jtl拉，b
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bcdr jtl可以參照jri lee的cdr analysis p
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aper, 但實際你在做的時候會有latency ,ph
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ase noise, kp/ki mismatch, Iq offset, d
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ata isi等問題會惡化jtl
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推
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至於你上一篇有提到bw大jtl好, 但recover
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clk jitter大, 反之則相反，我個人是認
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為啦，cdr是看tracking ability , 跟pll
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有點不同，pll是要clk jitter performance
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好, 但cdr要jtl好，你如果cdr 的clk都追
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不上data的變動,那jitter做的在小都是枉然
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，因此cdr的bw做大點會比較好，但是阿，
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做太大你會發現高頻jtl會惡化的很快，因
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此有個trade off，你會發現規格定義大多jt
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l的高頻轉折點都在1-20MHz之間，至於你如
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果把bw做高導致clk抖很大，其實也不用太
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擔心啦，過s2p能正常解到低速就沒問題了，
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數位那邊很慢的，不怕。
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推
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如果要做bbcdr穩定度也是要考量，可以參
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考walker的paper, 裡面有個stability fact
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or 跟 damping factor不同，它只是一個概
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念，讓你知道你的kp必須大於ki，否則jtl在
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轉折處會下探，至於要大多少就跑跑行為模
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擬吧，基本上我覺得只要確保jtl沒有下探
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的太嚴重應該就可以了，另外，bbcdr濾波
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器只會用r串c並聯那個小c要拿掉,不然kp會
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等校被衰減，jtl中頻會下探。
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推
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至於vco phase noise要給多少可能就比較
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麻煩了，如果你是linear cdr那還好處理，
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如果是bbcdr要跑個行為才能比較精準的算出
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jtl(要把vco帶入pn)，或是簡單估算一下把v
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co pn 從jtl轉折點小十倍的頻率積分到高頻
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，得出rj, 無noise jtl-14rj=有noise jtl
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(Ber 10-12) 僅現，高頻jtl才能這樣算
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謝謝xpear大，後來我的電路鎖上了
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之前所不上的原因發現是終點頻率的電壓太
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高了，鎖上後jitter就有照著設計的變化
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文章代碼(AID): #1PVZJ3eA (comm_and_RF)
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