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討論串[新聞] 全球最大EDA公司Cadence停止對中興服務

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Re: [新聞] 全球最大EDA公司Cadence停止對中興服務

推噓6(6推 )留言11則，0人參與作者SMIC5566 (目標是foundry廠前三名！)時間7年前 (2018/04/23 13:25)資訊

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學生的問題就用寫給學生的文章來回應. 春招来临，百道笔试面试题为你助力！. https://mp.weixin.qq.com/s/ZMSUEiEAF9eWqxMmz0Xx3Q. 台灣IC相關的學習資源很多. CIC官網點點看看就有不少訊息了… 羨慕. -----. Sent from JPTT o

Re: [新聞] 全球最大EDA公司Cadence停止對中興服務

推噓4(4推 )留言12則，0人參與作者jdward (321)時間7年前 (2018/04/23 10:43)資訊

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.... 等等，. 中興印象中是純系統廠?. 記得只有華為有開一間海思專門做 IC，. 中興還是他的子公司有做什麼 IC ，. 有朋友可以開示一下?. 自問自答，有找到一間中興微電子，. http://www.sanechips.com.cn/. 看名字應該是中興的子公司.... --. ※ 發信站

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Re: [新聞] 全球最大EDA公司Cadence停止對中興服務

推噓0(0推 )留言2則，0人參與作者dakkk (我是牛我反芻)時間7年前 (2018/04/23 09:02)資訊

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其實我沒很熟就我所知. 數位verilog 轉layout. 大部分就是轉成nand nor not 這三個閘. 不同製程參數會不太一樣例如metal跟metal之間會有最小距離. 顧完參數後再來要沿著clock path做最佳化牽涉到之後面積功率效能. 如果沒tool 幾千萬個邏輯閘

Re: [新聞] 全球最大EDA公司Cadence停止對中興服務

推噓11(11推 )留言23則，0人參與作者h9602b (電子學)時間7年前 (2018/04/23 05:33)資訊

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---------------------------------. 就讓小小魯蛇APR解釋一下. 問題就在"但是應該也是敲完verilog之後就轉成layout了". 學生會這樣認為還蠻正常的，台灣學界做EDA/實體設計的非常少，也不受重視. 少到當初念碩班都覺得畢業要失業了@@. RTL只是IC

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Re: [新聞] 全球最大EDA公司Cadence停止對中興服務已刪文

推噓28(32推 )留言80則，0人參與作者ypc1994 (dicker)時間7年前 (2018/04/23 00:24)資訊

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本魯是學生. 看了這串討論串. 有些地方不了解想問一下. 如果我沒有使用錯cadence tool. cadence大家最常用的應該是建schematics. 我平常也幾乎都沒在用cadence建電路. 都是直接敲netlist比較快. 數位方面我是比較不熟悉. 但是應該也是敲完verilog之後就

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