[理工] [計組] 98交大資工

看板Grad-ProbAsk作者 (小YO)時間15年前 (2011/02/04 14:37), 編輯推噓2(2推 0噓 12→)
留言14則, 6人參與, 最新討論串1/2 (看更多)
Assume virtually addressed cache is used, is it possible to have TLB miss, but page table and cache hit for a data access? Please explain you answer. -- 高銘解答：不可能，因為virtually addressed cache是將TLB從資料路徑移開，即不需要 存取TLB以降低存取延遲時間。因此不可能在TLB miss而page hit且cache hit。 -- 張凡解答：可能，when data is in both cache and memory and mapping in page table ,but not in TLB. 所以這題到底是possible還是impossible..? -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 114.39.4.244
推
02/04 22:42, , 1F
後者
02/04 22:42, 1F
推
02/05 00:14, , 2F
我也覺得是後者@@"
02/05 00:14, 2F
→
02/05 11:49, , 3F
我印象中這題的意思好像不同
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02/05 11:55, , 4F
他這題設計了兩個address cache
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02/05 11:55, , 5F
一個physical 一個是virtual
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02/05 11:58, , 6F
我翻書沒找過這樣的設計= = 不過我覺得高銘講的可能是對的
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02/05 12:14, , 7F
書上有。只是在Elaboration
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02/05 14:07, , 8F
Elaboration??
02/05 14:07, 8F
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02/06 00:28, , 9F
唔@@ 星期一題庫班會講到這題 我看看汪老師怎麼說 囧"
02/06 00:28, 9F
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02/06 00:31, , 10F
我看汪老師給的答案是 impossible喔~~ @"@
02/06 00:31, 10F
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02/06 07:20, , 11F
現在就出在他所說的virtual address cache是哪種tag
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02/06 07:20, , 12F
如果他的virtual address cache是用physical tag以解
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02/06 07:20, , 13F
aliasing問題，那impossible吧...
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09/11 14:12, , 14F
一個physical https://daxiv.com
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