討論串請問一下數位問題(FPGA)
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※ 引述《soonsin.bbs@bbs.mgt.ncu.edu.tw (窩耶)》之銘言：. 請問一下 我有算過真值表. 但是我不太曉得以下寫法是否有不同. process(clk). begin. if clk'event and clk='1' then. D1<=D0;D0<=ext;. ou
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你使用的語法是VHDL 不是很清楚. 但是你的寫法的確就blocking跟non-blocking的差異. 而這兩種有什麼差異 你可以隨便去找一個verilog的manual都會講到這點. FPGA本身有乘法器可以使用 當你寫電路時 只要instance乘法器即可. utilization只是你使用
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==> boy0.bbs@bbs.cs.nthu.edu.tw (漫天回憶舞秋風) 提到: 這是啥呢 有啥資料或書可以參考阿 謝謝. 懂了以後你就知道這兩者之間有什麼差別了 請問這些有差喔 我以為的乘法器是一直移位在加起來耶 感覺會大於一個clk. 抱歉喔 我是新手拉 有錯請多多訂正我 還請高手推薦
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※ 引述《soonsin.bbs@bbs.mgt.ncu.edu.tw (窩耶)》之銘言：. > process(clk). > begin. > if clk'event and clk='1' then. > D1<=D0;D0<=ext;. > output<=((D0 and D1) or
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請問一下 我有算過真值表. 但是我不太曉得以下寫法是否有不同. process(clk). begin. if clk'event and clk='1' then. D1<=D0;D0<=ext;. output<=((D0 and D1) or output) and (D0 or D1);.
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