Re: [問題] IC內部接地跟外部接地差在哪?
※ 引述《BlueFeel (藍色感覺)》之銘言：
: 如果有一個IC
: 輸出30MHZ的CLOCK訊號
: 如果它有一個PIN,裡面是一個MOS,
: MOS開的時是HIGH,LOW時接地
: 那麼我一直讓他LOW接地....
: 並且,layout從那個pin拉出來......與那30MHz靠很近
: 請問他會有隔離效果嗎?
: 30MHz的crosstalk遇到一個低電位(mos接到地)訊號,
: 導到ic內的gnd會有什麼影響嗎?
: 或者說......透過這mos接地......與直接接地........會差很多嗎?
這種雜訊的隔離我有嘗試過一次，如下所示
--------------- Gnd (logic '0')
▄▄▄▄▄▄▄▄ Signal
---------------- Gnd (logic '0')
上下兩條ground的訊號在不動作是都是邏輯0。距離是最小的金屬線寬(0.25um)
(它們是從一顆反相器出來的)
因為佈局工程師的誤解，以致於在不想改動太多的情況下，只好作這樣的補救。
結果看起來,中間那條Signal的波型在示波器雖然有點髒，但至少沒有失真的很嚴重。
可以讓下一級的輸入是正確接收到的。
基本上直接接到地會比較好，因為你不用再透過MOS，多一顆mos，雜訊會再多經由
一層well/junction，而且在這顆mos動作時，也會引入noise，這樣隔離的效果變差
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