Re: [問題] 有關 MOS WAFER 晶向問題

看板Electronics作者 (水精靈)時間17年前 (2008/06/02 19:01), 編輯推噓1(100)
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※ 引述《d813235 (黑仔)》之銘言: : 一般常看到的Wafer很像大都是(100)的晶向,有聽老師說過 : 很像(100)的腐蝕高過(111),但只提到一點點 : 我在想是不是還有其他原因 : 不知道有沒有人知道這個資料呢 謝謝 我們先來說說為何BJT要用(111)的做,而MOS要用(100)。 這部份主要是考慮到,在蝕刻與離子佈值時對元件特性的問題。 之所以BJT 製造於(111)wafer上,是因為過去使用擴散或離子佈值(Ion Implant)的 方式將 Emitter與Base layers垂直的將dopant參入。依此方法若使用(100) wafer時, dopant會經由(100)面中的通道(channel) 加速擴散滲入,使得每層layer的深度不均, (甚至有Emitter和Collector相連的現象),導致元件通通都死掉。 而(111)wafer從上往下看,晶體結構中沒有如(100)的channel,所以擴散或用ion implant的dopant深度均勻且易控制,不過,現在用磊晶(epitaxy)後,可能就不同了。 再者,MOS製作於(100)wafer上是為了讓gate oxide 有較好的品質。若使用(111)wafer 由於表面矽的接腳較多支,而氧接上去後,表面或氧化層仍會殘留有許多懸鍵(dangling bonds),做成元件後,這些地方則成了氧化態(oxide state)或是所謂的表面態(surface state),載子一經過就被捉住,陷在裡面出不白,結果元件特性就變差了。 至於你的蝕刻問題,小弟先不講,你可以去翻閱一下製程的書,或是搜索關鍵字 "橫向蝕刻" or "縱向蝕刻(vertical etching)"或是"非等向性蝕刻"這類的字, 另外,這也跟蝕刻速率有關。 -- 在臺灣,何謂R&D工程師? 1.Reverse and Decap :IC反相工程,去膠,打開封裝,拍照,複製電路佈局。 2.Resign and Die :沒死的就操到辭職,沒辭職的就操到死。 3.Rework and Debug :計畫永遠跟不上變化,變化永遠跟不上老闆的一句話! 4.Relax and Delay :太過於輕鬆(Relax),那麼就會Random Death (隨時陣亡) 但是外派到大陸的臺彎郎,晚上是R (鴨)陪客戶,白天是D (豬)任人宰割! -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 203.66.222.12

06/05 11:29, , 1F
原來是這樣呀!! 謝謝你
06/05 11:29, 1F
文章代碼(AID): #18GzCScq (Electronics)
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