Re: [問題] 關於ＶＨＤＬ的問題！！
※ 引述《chyihuann (作用力┴運動方向)》之銘言：
: 各位板上的大大，想請教一下一個關於ＶＨＤＬ的觀念
: process(clk)
: begin
: if clk'event and clk='1' then
: if keyclk='1' then
: qld <= not sw1;
: end if;
: q1dly <= q1d;
: end if;
: end process;
: 我上課的時候老師交了一個程式，其中片段如上
: 我想請教的問題是為什麼qldly會ＤＥＬＡＹ qld一個ＣＬＫ？？
如果是電腦程式，一般來說電腦會從上面一行一行執行下來。
VHDL是描述數位電路，在該clcok發生之時，被clock驅動到的電路
都同時作了相對應的動作。
如果你想懂了，以後類似的問題都懂了 :)
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