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作者 zadarler 在 PTT [ Electronics ] 看板的留言(推文), 共94則
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3F推: 我之前也遇過比較奇怪的收斂問題是 negative prob 要選g03/20 15:07
4F→: nd! 才會收斂 選vss 反而無法收斂03/20 15:07
5F→: vss 是我用vdc 給dc=0 自己命名的03/20 15:08
3F推: 幾10Mhz使用三級就可以了 輸出再用d2s 拉到rail to rail03/20 15:01
6F推: 補充一下 使用lstb 就不需要將下一級loading 加回去11/07 22:08
7F推: 先從cic投影片看起吧07/23 13:03
6F推: 建議m3 gate電壓往下調 同時m3 size增加 就可以解決了06/10 02:10
5F推: 我覺得樓上b大的作法比較直觀03/01 18:28
9F推: 當Q1 gate比Q2 gate來得高,電流完全會往Q1流,所以sour11/26 21:08
10F→: ce 會follow Q1 gate;同理當下個週期Q2 gate比Q1 gate11/26 21:08
11F→: 來的高時,source 那點就會follow Q2 gate,所以source11/26 21:08
12F→: 那點會一直都是波峰的形狀,那張圖的source 部分畫的11/26 21:08
13F→: 不是很正確11/26 21:08
14F推: 印象中source那點頻率會是訊號的兩倍,有興趣可以跑一下11/26 21:12
15F→: hspice 看一下波形。11/26 21:12
7F推: hspice -i xx.sp -o xx.lis07/21 14:25
17F推: 我猜是在.lis裡面看到 有可能是initial condition 造成06/30 14:04
18F→: 的問題06/30 14:04
1F→: 2mm^2=2(mm)^2=2(10^-3m)^2=2*10^-6m^212/26 22:27