作者查詢 / shengyeh
作者 shengyeh 在 PTT [ Electronics ] 看板的留言(推文), 共137則
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1F推: 已經寄信給你說明07/07 08:17
1F推: DICKSON最基本07/02 11:51
1F推: 是SINGLE POWER還是DUAL POWER?07/01 07:46
2F→: 如果電源只有一組 其實不太需要設定那些東西07/01 07:47
3F→: 你可以在CHECK LOG FILE搞不好是其他問題07/01 07:48
4F→: 混訊模擬的環境 CISTOMSIM 比較好用 07/01 07:49
5F推: 感覺你應該是模擬FILE就有問題了 不是設定的問題07/01 07:51
6F→: CUSTOM-SIM07/01 07:55
7F推: 有點不懂你說的 VCS+NANOSIM COSIM環境是一起跑 07/01 15:30
8F→: 你是VERILOG TOP還是SPICE TOP?07/01 15:33
9F→: 你可以CHECK一下有沒有認到你的POWER NET07/01 15:34
10F推: 我之前指的是說一些檔案VCSAD.INIT這些 有沒有寫錯07/01 15:48
11F推: 然後就是數位與類比模組的SYMBLE NAMING順序很容易錯07/01 15:56
12F→: 你如果是SPICE TOP 那要建數位的SYMBOL 且順序與HDL要合07/01 15:58
13F推: 建議看仔細log file 確定界面連線07/01 18:20
14F→: 我做是標準做法 沒什麼問題07/01 18:22
15F推: 不過cfg一般用於設定nanosim的模擬條件07/01 20:54
16F推: 跟cosim沒直接關係07/01 20:54
17F→: 感覺有點隔空捉藥 你跑完後其實多很多檔案 07/02 11:52
18F→: .MAP .DGL都要檢查一下07/02 11:54
19F→: 標準做法conpile netlist 建partition後 執行simv07/02 11:55
1F→: 沒寫過 不過你給的圖 就是計算SWITCHCING CV2的變化?07/01 07:53
3F推: 不同switch scheme 一次切換的容值與壓差不同07/01 18:16
4F→: 算cv2 應該就是了 我是直接採用vcm based的做法07/01 18:17
2F推: 建議你先看active rc 跟op06/26 11:26
3F→: 連basic都不懂 很難回答06/26 11:27
4F推: 如果你只是要應用 非設計06/26 11:35
5F→: 供這種應用的op 有提供rc值06/26 11:36
6F推: rf cf是設值 cs cp是雜散電容06/26 11:38
7F→: cc cp都是雜散電容06/26 11:40
17F推: 記得挑 low noise 的 我猜你輸出電壓訊號 應該很小06/26 20:29
18F→: 版子要注意畫06/26 20:29
1F推: 要看你的封裝 不同封裝等校電路值不同06/13 16:24
1F推: im6-im2=im706/01 20:01
2F推: 我m7電流方向寫反了06/01 20:05
3F推: im5=im606/01 20:07
6F推: 應該是要m2 m4, 對應到i1 i2 , 然後才等於 vsense/r06/02 04:47
7F推: 流過m2電流不會剛好是vsense/r06/02 04:49
8F推: m2 m4 偏壓電路是replica 只有差在前端 一各是0 一是vs06/02 04:53
9F→: 所以電流相減等於 vsense/rs06/02 04:54
10F推: nmos overdrive要設計小一點 前述公式會比較準06/02 05:22
25F推: 參考一下 DUAL SLOPE ADC06/01 09:04
1F推: 這是WILSON類似的架構阿 你要從D端看阿05/31 08:37
2F→: 從D端看ROUT依樣會BOOST05/31 08:37
7F推: 你們說的沒錯 D端看到的輸入電阻還是會放大 不用看S端05/31 11:32
8F→: 輸出阻抗05/31 11:33
9F→: regulation本來就會增輸出阻抗05/31 11:34
10F推: 我搞錯了 這跟阻抗沒關係05/31 11:43
3F推: 先手算一下 在模擬合不和理吧05/31 06:24