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/ bruceokla
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作者 bruceokla 在 PTT [ PLT ] 看板的留言(推文), 共3則
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Re: [問題] VHDL
[ PLT ]
3
留言, 推噓總分:
+2
作者:
appendixisu
- 發表於
2008/03/28 20:00
(18年前)
1
F
推
bruceokla
:process內的assign需要過一個趨近於零的delta_time
06/09 00:49
2
F
→
bruceokla
:就算使用功能性模擬也是存在,因此第二個訊號如果被觸發
06/09 00:51
3
F
推
bruceokla
:會影響指定的值,也跟你描述順序有關。
06/09 01:03
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