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討論串[請益] 這樣算是被亂發面試嗎?
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長話短說,不是亂發面試,. 公司的確是想找有軟體背景的來做數位IC設計和驗證,. 有可能是系統端的bring up, system validation,. 也有可能是UVM OOP,. 反正都需要軟體跟程式設計背景,. 反而是演算法的缺一般都是找純電機尤其偏好博士生,. 因為IC設計的演算法跟軟體
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年薪300的大大好. 小弟大學唸電子 研究所唸資工. 最近在校招中投了幾家豬屎屋的軟韌及演算法缺. 但是後來發的面試邀請卻是數位IC設計和驗證. 這樣算是被亂發面試嗎?. 還是看以前有學過verilog就發了呢?. 畢竟也好幾年沒再碰了. 不知道該不該去面. 對電路設計的概念幾乎都忘了. 同時也不是
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