Re: [請益] 請教電機所碩一修課及論文方向

看板Tech_Job作者 (熱火三)時間4年前 (2019/08/23 22:23), 4年前編輯推噓5(7210)
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※ 引述《r34796a (安安你好)》之銘言: : 各位前輩好, : 小弟是非純血四大電機所新生, : 指導教授是做通訊或ML相關, : 因為大學時相對喜歡程式, : 所以沒修過通訊原理相關的課, : 爬文發現碩士的論文的研究領域跟未來找工作不一定有關, : 尤其是通訊系統組出來除了強者以外幾乎都往軟韌體發展, : 因為如果做通訊相關的論文要補的理論知識太多了,(大學完全沒認真學) : 如果做ML的論文應該只要修機器學習導論與 : 線性代數, : 這樣可以把時間拿來修計算機程式、計算機組織、資料結構、DSP、機器學習, : 想請教各位前輩 : 1.如果通訊系統組往軟韌體發展,但他們還是有通訊的相關背景知識,未來工作是否用得 : 上? : 如果我做機器學習,只修上述的課程,而沒有通訊的知識,未來也可以做韌體工程師嗎? : (目標是MmNR) 我只面過M, 但感覺面軟韌體比較會問的就是C語言和作業系統 曾經問過主管他怎麼挑人的,主管說主要就先看學歷和成績 通訊知識有當然加分,但工作後再學也是ok 套句主管的話,開始工作很多東西都是重新學的 其實你可以先問問學長姐畢業都去哪些公司, 如果那間公司他們大多都面得上的,那你面上的機率應該也不會太低 : 2.爬文也說做機器學習的工作很慘,但論文跟工作無關,所以我未來找工作可以找ML相關 : 或其他,算進可攻退可守? 你當然可以找ML相關的工作,就看薪水你滿不滿意,大多人應該都會面試多個職缺 再從得到的offer中選擇自己最想要的 論文跟工作可能相關也可能完全無關,看面試主管的個人偏好 不過很多人拿到offer的時間點是在碩一升碩二的暑假或是碩二上 基本上那時候論文的完成度都很低,甚至有些人題目都沒確定 但照樣找到工作,所以應該蠻多主管是不在意論文主題的 : 3.如果碩班沒下過晶片,只靠修課的話未來有機會做IC design嗎?那要修哪些相關課程 : ? : 先謝謝各位前輩 : 因為graduate板學生居多,故來此發問。 有機會,但還是得看學歷。有些台大ICS組的畢業沒下過晶片,照樣當designer 當然最好先對ic design流程有些基本認識較好 -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 1.171.60.234 (臺灣) ※ 文章網址: https://www.ptt.cc/bbs/Tech_Job/M.1566570227.A.D93.html

08/23 23:06, 4年前 , 1F
結果不去研所版問還是一個學生來回答他XDDDDDDDDDDDDD
08/23 23:06, 1F

08/24 00:44, 4年前 , 2F
請問碩一升碩二是要去投履歷嗎 還是公司直接會來找人
08/24 00:44, 2F
去投公司的暑期實習,如果暑期實習有應徵上,表現不要太差 主管應該就會問你畢業後要不要來了

08/24 00:45, 4年前 , 3F
台大ICS組沒下晶片可以畢業??我還沒聽過欸XDDDDDDDD
08/24 00:45, 3F

08/24 00:45, 4年前 , 4F
DDDD
08/24 00:45, 4F
你認識的人太少吧,一切都看教授 ICS組現在都有人碩論弄deep learning了,不但沒下晶片連題目都脫離ic design 畢業照樣去猪屎屋當designer啊

08/24 00:45, 4年前 , 5F
我是清交其中一間 因為已經選定教授所以確定不會下晶片了
08/24 00:45, 5F

08/24 01:56, 4年前 , 6F
數位一堆只做到synthesis啊 沒聽過?
08/24 01:56, 6F

08/24 04:12, 4年前 , 7F
數位的還是會做到 apr 後 post layout simularion 或抽L
08/24 04:12, 7F

08/24 04:12, 4年前 , 8F
PE 跑Nanosim吧
08/24 04:12, 8F

08/24 07:51, 4年前 , 9F
看指導教授吧
08/24 07:51, 9F
※ 編輯: heatthree (1.171.153.166 臺灣), 08/24/2019 10:00:32

08/24 10:20, 4年前 , 10F
現在很多學校ic組下晶片的越來越少了
08/24 10:20, 10F

08/24 10:21, 4年前 , 11F
電路變複雜 越來越不好下 不少教授標準放寬
08/24 10:21, 11F

08/24 10:22, 4年前 , 12F
現在申請下的幾乎都類比的 數位很少顆
08/24 10:22, 12F

08/24 13:25, 4年前 , 13F
現在數位下晶片的真的不多r
08/24 13:25, 13F

08/24 13:48, 4年前 , 14F
有些論文只是合成報area而已 連gate level sim都不一定有
08/24 13:48, 14F

08/24 13:48, 4年前 , 15F
做....
08/24 13:48, 15F

08/24 15:36, 4年前 , 16F
gate level sim沒做 除非是很理論 不然就學校太廢..
08/24 15:36, 16F

08/25 15:51, 4年前 , 17F
他媽的我論文連verilog都沒寫也是ICS畢業,不要待在自
08/25 15:51, 17F

08/25 15:51, 4年前 , 18F
己Lab同溫層看世界。
08/25 15:51, 18F

08/25 21:03, 4年前 , 19F
只作到演算法階段的也是有
08/25 21:03, 19F
文章代碼(AID): #1TN_RpsJ (Tech_Job)
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