[問題] 在Verilog裡面開根號

看板Programming作者 (幻想的夢境)時間13年前 (2011/05/09 01:22), 編輯推噓2(2推 0噓 5→)
留言7則, 4人參與, 最新討論串1/1
現在寫Verilog用到開根號了 可是好像不能跟C一樣直接 x^(1/2) 有沒有知道的人該怎麼做阿? 不然我就得把另外一邊給平方了耶 可是超長的，我不想平方ˊˋ -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 123.192.76.53
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05/09 01:24, , 1F
C可以直接"^(1/2)"????
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05/09 01:35, , 2F
c的^是bitwise exclusive 不是power...
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在C裡可以用pow() 也是一樣用趨近法...
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05/09 01:38, , 4F
至於怎麼趨近 精準度多高 就有很多討論了
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推
05/09 02:49, , 5F
開平方根只會比平方更長....
05/09 02:49, 5F
推
05/11 00:28, , 6F
你作的動作，必需要能"合成"。
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05/11 00:28, , 7F
看Synthesis有這個功能嗎?不然要自己"寫"
05/11 00:28, 7F
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