Re: [理工] 張凡下冊140已刪文

看板Grad-ProbAsk作者 (andrew)時間6年前 (2019/10/09 12:38), 6年前編輯推噓1(103)
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※ 引述《tataTangQQ (TaTa)》之銘言: : https://i.imgur.com/fG5qqn3.jpg
: https://i.imgur.com/dYwkJh1.jpg
: 小弟想問第一小題:data cache的hit/miss : 我的想法是藉由offset (page多大)來看差距有沒有小於256B(block offset) : 但在0x4eae 5aaa 和 0x4eae 5a09差距不到256,但還是miss,所以我的想法應該是錯 : ,想問大大們怎麼求解QQ 我TLB M/H搞懂了,但是data cache M/H還是不懂,direct mapping的話應該是同一個in d ex只能放一筆資料吧?如果出現第二筆就用LRU取代掉! 然後以我的做法做到最後一個(0x103a e292)以前都是對的,但是最後一個address就錯 了……第一筆virtual address的block address應該就和最後一筆一樣吧?(都是0x103a) 怎麼會miss? 請問我觀念哪裡有錯嗎? -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 27.247.229.46 (臺灣) ※ 文章網址: https://www.ptt.cc/bbs/Grad-ProbAsk/M.1570595937.A.AAB.html

10/09 15:43, 6年前 , 1F
因為他只有兩個 entry 所以被 LRU 取代掉了吧
10/09 15:43, 1F

10/09 15:43, 6年前 , 2F
另外想確認一下 看了原原PO的敘述遲疑了
10/09 15:43, 2F

10/09 15:47, 6年前 , 3F
噢沒事 直覺往上看結果被坑了 = ="
10/09 15:47, 3F

10/09 21:45, 6年前 , 4F
對不起我講錯了,我是data cache不懂………
10/09 21:45, 4F
※ 編輯: Aa841018 (27.247.229.46 臺灣), 10/09/2019 21:46:09 ※ 編輯: Aa841018 (27.247.229.46 臺灣), 10/09/2019 22:01:22
文章代碼(AID): #1TdMHXgh (Grad-ProbAsk)
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