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討論串[問題] 請教Verilog入門書籍
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Re: [問題] 請教Verilog入門書籍
推噓3(3推 0噓 48→)留言51則，0人參與, 最新作者zxvc (眾生都是未來佛)時間13年前 (2012/08/14 19:22), 編輯資訊
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有些人說"用C(behavioral-level)的方式去寫Verilog(gate-level)會令人想哭"，. 這句話有些情況是這樣沒錯。. 但把這句反過來，也一樣會讓人想哭：. "用gate-level的方式去寫behavioral-level會令人想哭". 怎麼說？我舉個例子，雖然應該沒有人
(還有456個字)
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[問題] 請教Verilog入門書籍
推噓10(10推 0噓 24→)留言34則，0人參與, 最新作者NightKill (隨風飄逸)時間13年前 (2012/08/09 15:32), 編輯資訊
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我平常用的是VHDL語言，並使用Xilinx ISE作為開發環境。. 最近我想使用Verilog語言來撰寫，請問有適合的入門書籍推薦嗎??. 當初使用VHDL是因為學長都用這種語言，可是業界好像都用Verilog，. 於是想開始自學將語法改為Verilog。 可以順便問一下Verilog 與 VHD
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