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討論串[請益] verilog如何在一個always判斷觸發源？
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Re: [請益] verilog如何在一個always判斷觸發源？
推噓2(2推 0噓 15→)留言17則，0人參與, 最新作者tkhan (腦殘綠吱吱)時間17年前 (2008/04/18 00:27), 編輯資訊
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always @(in0 or in1). begin. if(in0). a=0;. else if(in1). a=1;. else. a=0;. end. 上課要認真... 這是基礎中的基礎... --. ※ 發信站: 批踢踢實業坊(ptt.cc). ◆ From: 220.157.114.1
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[請益] verilog如何在一個always判斷觸發源？
推噓1(1推 0噓 1→)留言2則，0人參與, 最新作者icetofux (豆腐)時間17年前 (2008/04/17 23:10), 編輯資訊
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input in0,in1;. reg a;. always@(in0). begin. a=0;. end. always@(in1). begin. a=1;. end. 在軟體模擬上，compile會通過，也能進行波形模擬，但是以donwload用的軟體去進行. compile，則會告訴不能讓
(還有8個字)
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