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討論串不經合成可知道大約的cell數嗎？
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#3
Re: 不經合成可知道大約的cell數嗎？
推噓0(0推 0噓 0→)留言0則，0人參與, 最新作者andy2000a.時間20年前 (2006/03/08 21:01), 編輯資訊
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==> 在 sdl.bbs@bbs.nsysu.edu.tw ([♂]我是口琴瘋子！) 的文章中提到:. > > 用verilog寫一個電路. > > 可以用好幾種架構來實現. > > 光是我專題其中某一部分. > > 我腦中就有好幾種不同架構. > > 像是8*8的乘法器. > > 用1bit*8
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#2
Re: 不經合成可知道大約的cell數嗎？
推噓0(0推 0噓 0→)留言0則，0人參與, 最新作者sdl.時間20年前 (2006/03/06 13:32), 編輯資訊
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> ==> wattlu.bbs@bbs.ykvs.tpc.edu.tw (哈利瓦特) 的文章中提到:. > 用verilog寫一個電路. > 可以用好幾種架構來實現. > 光是我專題其中某一部分. > 我腦中就有好幾種不同架構. > 像是8*8的乘法器. > 用1bit*8bit 經過移位再累加8
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#1
不經合成可知道大約的cell數嗎？
推噓3(3推 0噓 3→)留言6則，0人參與, 最新作者wattlu.時間20年前 (2006/03/05 17:32), 編輯資訊
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用verilog寫一個電路. 可以用好幾種架構來實現. 光是我專題其中某一部分. 我腦中就有好幾種不同架構. 像是8*8的乘法器. 用1bit*8bit 經過移位再累加8次. 真的會比直接用8bit * 8bit的面積還小嗎？. 我覺得直接拿去合成真的蠻浪費時間的. 有沒有人知道到底要怎麼樣才能不經
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