關於IC Layout寄生電容的問題

看板Electronics作者 (BO_RAY)時間5年前 (2018/08/07 22:21), 5年前編輯推噓2(2推 0噓 13→)
留言15則, 6人參與, 5年前最新討論串1/1
小的剛學IC layout沒多久 想請問在DRC LVS 驗證都過情況下 做pex C+CC 抽取後發現電路產生了許多寄生電容 也因此對電路的性能造成很大影響 (尤其是功率的部分) 想問問各位佈局高手，在做佈局時需要注意甚麼 或是有一些技巧能不要讓寄生電容產生? 再請問，兩層金屬板之間容易產生寄生電容，那在這情況下 是否同一層金屬就不適合都畫在同方向? 小的新手，請高手指點 !! 謝謝 ! -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 120.105.92.145 ※ 文章網址: https://www.ptt.cc/bbs/Electronics/M.1533651698.A.248.html
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08/08 15:02, 5年前 , 1F
垂直走線
08/08 15:02, 1F
垂直走線是指佈局的時候 還是？ ※ 編輯: ray0514 (117.19.36.55), 08/08/2018 15:16:35
推
08/08 22:41, 5年前 , 2F
有查過是哪一個點的問題?PEX可以看看是哪裡造成c/cc
08/08 22:41, 2F
我在佈局的時候習慣將同層金屬都畫在同一個縱相或是橫向而且很密集這樣會造成寄生電容嗎？還是走線太長影響會比較大
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08/08 22:43, 5年前 , 3F
要說減少寄生電容當然是減少連接線長度 但你也要先知道是
08/08 22:43, 3F
大大您好 看的到程式中哪點的寄生電容比較大，但是我看不懂他的數字編號是指哪點
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08/08 22:44, 5年前 , 4F
哪一條線出問題
08/08 22:44, 4F
※ 編輯: ray0514 (117.19.36.55), 08/09/2018 10:05:19 ※ 編輯: ray0514 (117.19.36.55), 08/09/2018 10:07:27
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08/09 10:10, 5年前 , 5F
數字編號可以拿去反查位置....
08/09 10:10, 5F
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08/09 10:26, 5年前 , 6F
我記得在RVE可以點那點 Layout那裡會直接highlight
08/09 10:26, 6F
謝謝！我再試試看
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08/09 11:23, 5年前 , 7F
是在做哪種電路呢？
08/09 11:23, 7F
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08/09 12:51, 5年前 , 8F
原po好像是做去年cic初賽的題目 紅綠燈
08/09 12:51, 8F
※ 編輯: ray0514 (117.19.36.55), 08/09/2018 12:54:09
推
08/09 17:13, 5年前 , 9F
同一層走同一個方向對繞線來說會比較容易吧
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08/09 17:13, 5年前 , 10F
如果要減小同層metal所造成的cc最有效的應該是加大spacing
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08/09 17:15, 5年前 , 11F
功耗的部分要考慮是不是兩條訊號toggle的方向相反，導致dr
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08/09 17:15, 5年前 , 12F
iving loading變重
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08/09 19:02, 5年前 , 13F
考量面積 以.18製程繞線的方式可以用 例如m2 m4金屬走
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08/09 19:02, 5年前 , 14F
水平方向 交錯使用或許是方法 既可以減低寄生電容效應
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08/09 19:02, 5年前 , 15F
面積也能夠兼顧 m1 m3也是類似觀念
08/09 19:02, 15F
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