[問題] OP-amp用於unity gain buffer的設計

看板Electronics作者 (楓泠)時間11年前 (2013/02/01 18:36), 編輯推噓15(15推 0噓 16→)
留言31則, 13人參與, 最新討論串1/1
請問"要下線"的OP-amp的問題 我現在在做一個用於DAC末端的unity-gain buffer用的OP-amp 採用的OP-amp架構是2-stage cascode OP(為了達到High Gain以及wide Outswing) 單端輸出，當unity gain buffer的準確率要80dB，頻寬要1MHz， 因此放大倍率我設計在80dB以上，TT時81dB，當我在跑corn發現了問題。 在FF,FS,SF時，原來的80dB會掉到70dB，由於第二級的輸出電壓漂離我設定的0.9V的關係 (第二級輸出電壓其實很受第二級下端NMOS的gate電壓的影響) 想請問這種用於unity-gain buffer的OP-amp，能不能加CMFB去鎖住OP-amp的輸出 以及gate? 有什麼單端鎖定的CMFB可以使用嗎? 到目前看到的CMFB都是用於雙端輸出用的... -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 140.123.110.124
推
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用回授吧? CMFB 是給diff 用的
02/01 20:23, 1F
推
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單端的OP-AMP 輸出電壓是由另一邊的DIODE-MOS 決定吧?
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除非你的2nd stage 只是用一個普通的CS 而不是diff amp來做
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推
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bias電路有做好?
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bias電路...目前都沒有耶，本來是打算都用外部電源
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...那你變corner gain當然會飄很大
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※ 編輯: qazxsw101 來自: 1.175.146.94 (02/02 00:06)
推
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你Vb一定要用current mirror的方式去偏壓
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比如你第一第二級1:10，那size ratio也一定得對上
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corner才不會飄很嚴重
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你去參考最傳統2-stage OP他那個load是怎麼偏壓的
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你偏壓用電壓的方式給　最後量測一定死
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你以為你外面給那點沒有noise嗎　ㄎㄎ
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推
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台灣浪費教育資源的方法QQ
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推
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下線機會真寶貴 XD
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受教了!! 我會去改看看 再回來看corner有沒有飄這麼嚴重
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推
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因為你corner飄　電流外灌定值情況下　電壓會一起動
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overall來講是比你定死的外灌電壓多一個一起飄的行為
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人家飄　你一起飄 = 好
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推
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題外話　如果台灣規定碩士班學生不能下線就不會有資源問題惹
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推
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規定碩是要下線才能畢業也是這七八年來老師們殺紅眼啊
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推
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老師應該好好review學生的電路 一些中段學校學生天天wow
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兩年下線五顆fail四顆 到底要怪誰阿這 阿彌陀佛
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其實"前段"學校也是wow啦...
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推
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因為老師也不會
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推
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好久沒看到 obov前輩 推文..
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推
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中肯~ 不過現在審核比較嚴格 兩年要下4,5顆也很難惹
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推
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偉哉水桶哥
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推
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現在應該是天天LOL
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你去參考最傳統2-st https://muxiv.com
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下線機會真寶貴 XD https://daxiv.com
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