Re: [問題] 關於雙端的SAR ADC
※ 引述《deathcustom (litron-intl)》之銘言：
: ※ 引述《chenkaihsu (Harry)》之銘言：
: : 謝謝各位~~我似乎已經把想要減到的值
: : 調到差不多了....第一次切換啦~~
: : 但發生了一個問題~~所以想問問各位怎麼解決~~
: : 就是接再電容下板的SWITCH阿~~是用INVERTER接的
: : INVERTER的輸入是很漂亮的0或1.8V(FULL SWING)
: : 但輸出卻.....會有突波~~
: : 而這突波...影響到了HOLD住的值了
: : 我在想這突波發生原因應該是....第二次切換時候影響到了原本第一次切換的值了~~
: : 如下圖~~
: : http://ppt.cc/DFBL
: : 可是我把~~SWITCH SIZE用到很大時候~~就不會有這問題了~~
: : 所以想請問一下,這可能是我說的那種問題嗎??
: : 該怎麼解決內??
: : 謝謝~
: 主要的問題會在某些地方
: 降低操作頻率=>是否改善 是：操作頻率過高，settle 不完全
: 否：其他主因
: 更換switch形式或size =>是否改善 是：Parasitic C affects the linearity
: 否：其他主因
: 更換clocking操作模式、chopping等其他方式
: 這些才是會domain你的INL、DNL的地方
: 至於switch要選多大、甚麼形式，又會牽涉到thermal noise
: 請一次focus在一個地方去改善
※ 引述《deathcustom (litron-intl)》之銘言：
: ※ 引述《chenkaihsu (Harry)》之銘言：
: : 謝謝各位~~我似乎已經把想要減到的值
: : 調到差不多了....第一次切換啦~~
: : 但發生了一個問題~~所以想問問各位怎麼解決~~
: : 就是接再電容下板的SWITCH阿~~是用INVERTER接的
: : INVERTER的輸入是很漂亮的0或1.8V(FULL SWING)
: : 但輸出卻.....會有突波~~
: : 而這突波...影響到了HOLD住的值了
: : 我在想這突波發生原因應該是....第二次切換時候影響到了原本第一次切換的值了~~
: : 如下圖~~
: : http://ppt.cc/DFBL
: : 可是我把~~SWITCH SIZE用到很大時候~~就不會有這問題了~~
: : 所以想請問一下,這可能是我說的那種問題嗎??
: : 該怎麼解決內??
: : 謝謝~
: 主要的問題會在某些地方
: 降低操作頻率=>是否改善 是：操作頻率過高，settle 不完全
: 否：其他主因
: 更換switch形式或size =>是否改善 是：Parasitic C affects the linearity
: 否：其他主因
: 更換clocking操作模式、chopping等其他方式
: 這些才是會domain你的INL、DNL的地方
: 至於switch要選多大、甚麼形式，又會牽涉到thermal noise
: 請一次focus在一個地方去改善
分享個經驗
1. 用理想的switch看看是否會改善
e.g.
.subckt idealswitch in out control
g1 in out vcr pwl(1) control 0 0v,0.5g 1.2v,0
.ends idealswitch
是 => 如d大所說 settle不完全
否 => 可暫時排除 switch 問題
2. 如果有op了話 用理想的 op 看看是不是reference電壓跑掉
e.g. 懶的寫了反正是用e開頭的
.subckt op xxxxx
exxx xxx xxx .....
.ends
是 => reference電壓跑掉
否 => 其他
3. 用個理想 DAC 看看是不是單位電容太小或太大不合理
e.g.
G1 VDD1 OUT_B b8n GND 128 (msb)
G2 VDD1 OUT_B b7n GND 64
.........
如果有用到op了話
op 正負兩端一端接取樣電路一端接DAC 的電容 loading最好要一樣
反正 SAR ADC 大概就這幾項
如果都不是了話 大概就是電路接錯了 (笑)
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※ 發信站: 批踢踢實業坊(ptt.cc)
◆ From: 1.169.172.79
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