Re: [請益] 有人有做好的OTA的sp檔可以給我修改嗎?

看板Electronics作者 (要過年了~~)時間16年前 (2010/04/07 02:22), 編輯推噓3(303)
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目前只達到gain/phase margin/unit-gain freq/output swing 的規格目標 gain= 6.2184E+01 at= 1.0000E+01 from= 1.0000E+01 to= 1.0000E+10 phase_margin= 6.8250E+01 unit_gain_freq= 2.0806E+08 swing 從avanwaves看 大概1.35V (0.25V ~ 1.6V) (我不知道我的暫態分析對不對) 以下是我的sp檔 我花了9個多小時才完成以下這些參數....我嫩到爆炸>< 哀 Two-Stage OP .lib 'rf018.l'tt .global vdd vss .temp 50 .option post nomod ************************************************ vdd vdd 0 1.8v vss vss 0 0v .SUBCKT OP inn inp out Ms1 7 7 vss vss nch w=2u l=0.18u Ms2 2 7 vss vss nch w=2u l=0.18u Rs vdd 7 83k M1 2 2 vdd vdd pch w=2u l=0.18u M2 3 2 vdd vdd pch w=3.5u l=0.18u M7 out 2 vdd vdd pch w=3.5u l=0.18u M8 out 5 vss vss nch w=3.5u l=0.18u M3 4 inn 3 3 pch w=12u l=0.18u M4 5 inp 3 3 pch w=12u l=0.18u M5 4 4 vss vss nch w=2u l=0.18u M6 5 4 vss vss nch w=2u l=0.18u Cc 5 6 1pf Rc 6 out 25k .ENDS OP X1 inn inp out OP Cl out vss 5pf *************AC ANALYSIS************ .op .ac dec 1 10 10G vinn inn 0 dc 0.9v ac 1v vinp inp 0 dc 0.9v ac 1v 180 .meas ac gain max vdb(out) .meas ac phase_margin find = vp(out) when vdb(out)=0 .meas ac unit_gain_freq when vdb(out)=0 .OPTION PROBE .PROBE VDB(OUT) VP(OUT) ***************TRANSIENT ANALYSIS******* *.op *Vinp inp 0 SIN(0.9V 0.9mV 50 0.000s) *Vinn inn 0 SIN(0.9V 0.9mV 50 0.005s) *.tran 1us 100ms *.OPTION PROBE *.PROBE V(out) V(inp) ***************Slew Rate************ SLEW RATE 的部分我還沒跑 也不知道怎麼測 *.op *Vinn inn out PWL(0ms 1 3ms 1 3.001ms 0 6ms 0) *Vinp inp vss *.probe V(out) .end 誰可以教我其它的規格要怎麼看和調整的訣竅? 感謝~~ ※ 引述《alfudimas (要過年了~~)》之銘言: : 想請問有沒有人有之前設計好的OTA的sp檔可以給我修改?? : (用TSMC 0.18um製程) : 我的規格如下 : min typical max unit : power supply 1.6 1.8 2 V : power consumption 越小越好 越小越好 越小越好 mW : open-loop gain 60 dB : common-mode gain @DC -20 dB : unit-gain frequency 1 MHz : phase margin 55 degree : capacitive load 5 pF : slew rate 0.1 V/us : output swing 1 Vpp : input referred noise 5 uV/sqrt : 規格不用達到也行 : 我再自己修改 : PS : 另外想問一下 : 調這些規格的順序 : 哪個先調整達到 哪個後來再達到?? : 還有我要在Hspice下 : 輸入哪些.option : 才能完全的顯示每一項規格? : 我本身不是做電路的>< : 可是目前急需完成這個電路 : 希望有人能幫忙 : 感謝~ : 我的MSN: timtimtimwu@homail.com : 感謝~ -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 140.113.150.8 ※ 編輯: alfudimas 來自: 140.113.150.8 (04/07 02:26)

04/07 03:24, , 1F
怎麼不用cadence直接來設計呢?
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訊號輸入的地方是不是有點怪怪的?
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04/07 10:38, , 3F
你那種寫法是全差動的OP寫法吧?
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如果是單端輸出 你只要再一端家交流訊號就可以了
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ac應該是兩邊都0.5
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04/07 15:26, , 6F
common mode gain 就是ac兩邊訊號的相位給一樣即可
04/07 15:26, 6F
文章代碼(AID): #1Bktle0X (Electronics)
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