作者查詢 / blacktea5

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作者 blacktea5 在 PTT 全部看板的留言(推文), 共2280則
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[請益] 清大電機教授
[ graduate ]15 留言, 推噓總分: +8
作者: rinamedia - 發表於 2018/10/21 17:28(7年前)
13Fblacktea5: 上次去cic 報告遇到謝的學生。真的精223.140.123.91 10/23 01:37
14Fblacktea5: 實223.140.123.91 10/23 01:37
15Fblacktea5: 真的強到意思114.136.227.11 10/23 15:42
[請益] 低通濾波電路的頻率是指什麼?
[ Electronics ]13 留言, 推噓總分: +4
作者: patricklee - 發表於 2018/10/18 22:44(7年前)
11Fblacktea5: 樓上正解。需要把fin 外的頻率成分壓低10/19 18:37
[問題] calibre的功能 抽C+CC MoM capacitor
[ Electronics ]7 留言, 推噓總分: +3
作者: Baneling - 發表於 2018/10/03 00:24(7年前)
2Fblacktea5: 叫出兩個沒用的nmos 全皆在一起街,分別街top bottom10/04 00:38
3Fblacktea5: 就可以看了10/04 00:38
4Fblacktea5: 因為沒訂一層所以不太可能叫出沒元件的方式10/04 00:39
6Fblacktea5: 打冒號就可以把元件看到的寄生影響變小10/05 17:48
[請益] 電力組推甄請益已刪文
[ graduate ]14 留言, 推噓總分: +9
作者: KagamiRaito - 發表於 2018/09/26 14:21(7年前)
1Fblacktea5: 電力組ee5樓很有名的114.136.236.59 09/26 14:30
[問題] 電晶體尺寸與驅動電流
[ Electronics ]3 留言, 推噓總分: +2
作者: davison - 發表於 2018/09/20 15:39(7年前)
1Fblacktea5: 電流公式出來,你就假設在飽和區vgs=1.8 vth =0.45你就09/20 22:04
2Fblacktea5: 可以算。或是接diode connet 做測試09/20 22:04
[閒聊] 如果只用NAND或NOR gate邏輯合成
[ Electronics ]16 留言, 推噓總分: +9
作者: FTICR - 發表於 2018/09/20 20:17(7年前)
1Fblacktea5: 我是不知道軟體,但是用電晶體做,inv只需要pnmos 個一09/20 21:59
2Fblacktea5: 個09/20 21:59
3Fblacktea5: 如果照你說的把兩個輸入皆在一起,是一個inv沒錯09/20 22:00
[問題] clock轉換
[ Electronics ]4 留言, 推噓總分: +3
作者: a1010223 - 發表於 2018/09/20 17:39(7年前)
3Fblacktea5: Shift register 4個phase然後做邏輯?09/20 21:57
[問題] two stage OP 相位問題
[ Electronics ]28 留言, 推噓總分: +13
作者: yuanzhai - 發表於 2018/09/16 22:03(7年前)
8Fblacktea5: 180度的相位轉(-gmRd)只是判斷正負端 而遇到pole 會09/18 00:59
9Fblacktea5: 掉相位又是不同的事情。一個dc 一個ac09/18 00:59
23Fblacktea5: -gmrd 的-跟你從哪裡灌訊號跟vo在哪裡看的關係是同向09/18 23:56
24Fblacktea5: 還是反向(0or180)。屬於dc09/18 23:56
25Fblacktea5: Pole因為Z=1/(jwC)在引入頻率讓phase會開始往下掉為ac09/19 00:03
26Fblacktea5: 。09/19 00:03
[問卦] 電機選什麼組別比較好阿??已回收
[ Gossiping ]44 留言, 推噓總分: +25
作者: pig0505 - 發表於 2018/08/20 19:18(7年前)
44Fblacktea5: 我同學 交大工工寫程式75k給你參考42.76.192.254 08/20 22:54
[問題] 想自學一些APR的相關知識
[ Electronics ]11 留言, 推噓總分: +6
作者: kingppt - 發表於 2018/07/30 14:36(7年前)
5Fblacktea5: 借串問,請問通常是verlilog電路用apr畫然後soc整合是07/31 00:30
6Fblacktea5: 用apr嗎?07/31 00:30