[請益] 請問有辦法從FPGA工程師轉IC設計嗎？

看板Tech_Job作者 (米魯比)時間2年前 (2021/09/23 00:49), 編輯推噓26(26推 0噓 30→)
留言56則, 34人參與, 2年前最新討論串1/3 (看更多)
各位先進大家好，小弟目前任職於一間設備開發公司，主要是撰寫FPGA， 另外約20%時間寫組合語言/C語言韌體，也有設計類比電路，及C++（QT）。 基本上就是依照需求想辦法把產品設計出來，該用什麼就用什麼。 目前工作的薪水不算高但是環境不錯，工作彈性，同事相處融洽。 不料最近公司有一些變動讓我興起轉職念頭。由於FPGA接觸的時間比較長 （三大FPGA都有在用），所以想用FPGA當作找工作的主力。一找才發現 寫FPGA其實路很窄，搜尋雖然有不少工作但是大部分都是IC設計的， 要有下線經驗，用FPGA當產品的公司其實很少，然後其中很多是版上風評不好的公司。 現在感覺前途一片黑暗。我想利用Verilog / FPGA的經驗當背景，然後花幾個月 補足一些IC設計的知識，切到三線IC設計公司，年薪比現在低也無所謂。 目前有找一些書與資料來看，但不多也不知道方向對不對。想請問前輩 ，我這樣的背景，要加強什麼，才會增加三線IC設計公司的錄取機會？ 謝謝。 -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 118.161.35.1 (臺灣) ※ 文章網址: https://www.ptt.cc/bbs/Tech_Job/M.1632329367.A.1CC.html
推
09/23 00:56, 2年前 , 1F
設備開發公司？有用fpga?
09/23 00:56, 1F
推
09/23 01:05, 2年前 , 2F
現在一線滿缺人的 直接面一線吧 面不上再來考慮其
09/23 01:05, 2F
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09/23 01:05, 2年前 , 3F
他的
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09/23 01:07, 2年前 , 4F
不用直接把自己天花板開在地下室 畫地自限
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09/23 01:07, 2年前 , 5F
會verilog 看一下白板題就能去面了
09/23 01:07, 5F
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09/23 01:08, 2年前 , 6F
fpga的轉asic的，在最熟悉的領域反而常掛掉
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09/23 01:10, 2年前 , 7F
比如如何串接reset ，還有怎麼測試unknown和非同步
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09/23 01:11, 2年前 , 8F
滿常見資深人員還帶著一些奇怪的樂觀假設
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09/23 01:11, 2年前 , 9F
必須說 會Verilog + FPGA跟實際IC廠落差還是很大
09/23 01:11, 9F
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09/23 01:12, 2年前 , 10F
不過現在外面搶人搶得兇 若學歷不差 就一線開始投吧
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推
09/23 01:14, 2年前 , 11F
直接投看看吧，基本上verilog會用然後VLSI學一下跟
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09/23 01:14, 2年前 , 12F
計算機組織會就可
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09/23 01:14, 2年前 , 13F
FPGA在IC廠只是拿來佐證IP，實務上幾乎都RTL+simula
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09/23 01:15, 2年前 , 14F
tion為主; 後端驗證FPGA+DV通常有專屬部門負責
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09/23 01:18, 2年前 , 15F
因此 若很熟FPGA又會SystemVerilog建議走DV
09/23 01:18, 15F
推
09/23 01:20, 2年前 , 16F
MTK有FPGA
09/23 01:20, 16F
推
09/23 01:40, 2年前 , 17F
確定想走IC設計 VLSI電路的知識避不了
09/23 01:40, 17F
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09/23 02:16, 2年前 , 18F
可以先把cdc跟async/sync reset的paper看熟
09/23 02:16, 18F
推
09/23 02:35, 2年前 , 19F
去查hedge fund,他們都有fpga 職缺，薪水高到嚇死
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09/23 02:35, 2年前 , 20F
人
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09/23 03:38, 2年前 , 21F
真的寫FPGA的專家在國外的薪水可是很高的
09/23 03:38, 21F
推
09/23 03:50, 2年前 , 22F
會用到FPGA的公司還是有的，可以再多找找
09/23 03:50, 22F
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09/23 07:23, 2年前 , 23F
切到三線沒有比較好 要不要徵看看mtk
09/23 07:23, 23F
推
09/23 07:42, 2年前 , 24F
可以啦，不過你的學歷 年紀？
09/23 07:42, 24F
推
09/23 08:18, 2年前 , 25F
三大 FPGA 都有用過，那裡面SoC 相關IP CPU bus 是
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09/23 08:18, 2年前 , 26F
否有整合過？如果都有整合過 應該會很搶手才對
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推
09/23 08:18, 2年前 , 27F
學歷四大。就沒問題
09/23 08:18, 27F
推
09/23 08:34, 2年前 , 28F
很穩的 開履歷就知道面試機會一堆
09/23 08:34, 28F
推
09/23 08:46, 2年前 , 29F
放心會fpga很搶手
09/23 08:46, 29F
推
09/23 09:26, 2年前 , 30F
直接投一線，不過通常會需要你繼續做fpga
09/23 09:26, 30F
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09/23 10:13, 2年前 , 31F
熟verilog的話，RTL應該自然就熟了吧
09/23 10:13, 31F
推
09/23 10:33, 2年前 , 32F
設備商跟真正ic廠RTL差距還蠻大的 想換建議就投看看
09/23 10:33, 32F
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09/23 10:33, 2年前 , 33F
進去重新練
09/23 10:33, 33F
推
09/23 10:36, 2年前 , 34F
有。快投履歷
09/23 10:36, 34F
推
09/23 11:32, 2年前 , 35F
寫FPGA大部分沒有最佳化 這點跟寫ASIC不一樣
09/23 11:32, 35F
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09/23 11:41, 2年前 , 36F
先去開一顆ic
09/23 11:41, 36F
推
09/23 11:56, 2年前 , 37F
FPGA Intel 等 網通晶片 需要
09/23 11:56, 37F
推
09/23 11:59, 2年前 , 38F
先投履歷啦
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推
09/23 12:28, 2年前 , 39F
錯了 fpga才要最佳化 他的clock tree是固定的 然後
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09/23 12:28, 2年前 , 40F
一個prj主管希望你用小顆一點gate counts超過80% 你
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09/23 12:28, 2年前 , 41F
就只能天天調timing
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推
09/23 12:28, 2年前 , 42F
沒差啦，連mux, flipflop都不知道的人還不是進一線
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09/23 12:28, 2年前 , 43F
廠數位RD了，我親眼看到的例子
09/23 12:28, 43F
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09/23 12:29, 2年前 , 44F
ic就算沒最佳化 clock tree可以沿著critical path
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09/23 12:29, 2年前 , 45F
長 就差很多
09/23 12:29, 45F
推
09/23 12:48, 2年前 , 46F
外商FPGA IC大廠試試看
09/23 12:48, 46F
推
09/23 12:50, 2年前 , 47F
一線很缺人, 四中以上問題不大
09/23 12:50, 47F
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09/23 13:35, 2年前 , 48F
CAD?
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09/23 13:50, 2年前 , 49F
先投履歷 面試 很快就知道
09/23 13:50, 49F
推
09/23 15:34, 2年前 , 50F
FPGA跳ASIC很容易吧
09/23 15:34, 50F
推
09/23 17:30, 2年前 , 51F
直接去找 現在缺人缺成狗
09/23 17:30, 51F
推
09/23 19:42, 2年前 , 52F
Verdi都不會用的都可以在一線大廠待好好的
09/23 19:42, 52F
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09/23 20:20, 2年前 , 53F
VHDL,組合語言,Verilog
09/23 20:20, 53F
推
09/23 20:44, 2年前 , 54F
做飛彈？
09/23 20:44, 54F
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09/24 18:18, 2年前 , 55F
比較好奇，幾歲算老？
09/24 18:18, 55F
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09/25 08:39, 2年前 , 56F
現在很缺人, 去應徵應該還是有機會。
09/25 08:39, 56F
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