[情報] 賀！學生研究獲 IEEE VLSI 接受
賀！本實驗室學生研究成果獲得 IEEE Transactions on Very Large Scale Integration Systems 接受，題目「A 0.5V 1.28MS/s 4.68fJ/conversion-step SAR ADC with Energy-Efficient DAC and Tri-Level Switching Scheme」
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※ 編輯: JerroLi (60.250.205.229), 11/22/2016 12:59:36