[理工] 計算機組織 pipeline

看板Grad-ProbAsk作者時間4年前 (2021/12/23 22:05), 編輯推噓1(1推 0噓 1→)
留言2則, 1人參與, 4年前最新討論串1/1
請問 https://imgur.com/McyqKYY
https://imgur.com/tXHYGPd
假設在沒有 strctural hazard 以及 cache miss 的狀況下 這兩題的 clock cycle 的數量要怎麼計算 ? 第一張圖的SUB和ADD會產生data dependecy 所以是要等到WB後才能執行ADD的IF嗎 ? (3-1)+5+4 = 11 第二章圖也是一樣嗎 ? 這兩題我實在看不太懂 麻煩大家指點一下 -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 114.45.193.24 (臺灣) ※ 文章網址: https://www.ptt.cc/bbs/Grad-ProbAsk/M.1640268343.A.4C0.html
推
12/23 23:04, 4年前 , 1F
剛好寫到 這是師大的萬年題目吧 有forward就是7跟8
12/23 23:04, 1F
→
12/23 23:05, 4年前 , 2F
沒有forward就是9跟11
12/23 23:05, 2F
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