[理工] 計組 算盤 P281

看板Grad-ProbAsk作者 (iamthinking)時間3年前 (2020/11/08 11:55), 編輯推噓2(2推 0噓 11→)
留言13則, 3人參與, 3年前最新討論串1/1
https://i.imgur.com/VeWb1O6.jpg
嗨，請教一下，這裡的IF/ID register，將左半塗色代表正在寫入，右半代表讀取 那假設一個指令A正在ID階段，指令B在IF階段，是A在前半個cycle先讀取，B在後半個cycle 寫入嗎？ 因為照前幾章Register的畫法，塗色左半代表前半個cycle，右半代表後半個cycle，但IF/I D Register這裡如果用同個邏輯想，先寫後讀，就會拿到錯的Data了，所以很困惑...... 謝謝 -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 114.36.95.24 (臺灣) ※ 文章網址: https://www.ptt.cc/bbs/Grad-ProbAsk/M.1604807717.A.A27.html
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11/08 20:36, 3年前 , 1F
可是AB指令在不同stage，使用不同function unit
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11/08 20:39, 3年前 , 2F
啊啊你是問IF/ID reg
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11/08 20:44, 3年前 , 3F
看不太懂你的問題QQ
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11/08 21:50, 3年前 , 4F
我寫得不太清楚，是指假設一個指令A正在下面的圖的狀
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11/08 21:50, 3年前 , 5F
態，一個指令B在上面的圖的狀態，A在ID，B在IF，
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B這時候要寫入IF/ID register，A在這時候要讀取IF/ID
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register，
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這樣是讓A讀完才讓B寫入嗎？
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11/08 21:50, 3年前 , 9F
是各別用半個cycle去做嗎？
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推
11/09 11:55, 3年前 , 10F
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推
11/09 11:57, 3年前 , 12F
也就是說，PC某種程度上也會算成是一個pipeline reg
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11/09 16:40, 3年前 , 13F
好詳細，了解了，謝謝你
11/09 16:40, 13F
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