[理工] 計組上冊527！

看板Grad-ProbAsk作者 (andrew)時間7年前 (2018/12/19 16:31), 編輯推噓2(2推 0噓 5→)
留言7則, 3人參與, 7年前最新討論串1/1
https://i.imgur.com/2J1BGHg.jpg
https://i.imgur.com/L4Apevc.jpg
想問（1）、（2）題，（1）實在搞不懂這答案怎麼來的？ （2）為何sub要停啊？如果add可以被lw 救，那肯定能救到sub才對啊！ 最後面c8 為什麼是ID也是一頭霧水… -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 27.246.222.43 ※ 文章網址: https://www.ptt.cc/bbs/Grad-ProbAsk/M.1545208308.A.3BE.html
推
12/19 16:59, 7年前 , 1F
2. add因為遇到load use所以要暫停一個clock cycle(
12/19 16:59, 1F
→
12/19 16:59, 7年前 , 2F
C6)所以下面指令所有在C6都要停一個clock
12/19 16:59, 2F
→
12/19 17:03, 7年前 , 3F
看懂了，可是c8那邊為什麼又再停一次，好像沒有data dep
12/19 17:03, 3F
→
12/19 17:03, 7年前 , 4F
endency!
12/19 17:03, 4F
推
12/19 17:08, 7年前 , 5F
(1) forwarding 20+mux 10+alu 30+pipeline register 1
12/19 17:08, 5F
→
12/19 17:08, 7年前 , 6F
5 就75了
12/19 17:08, 6F
→
12/19 21:19, 7年前 , 7F
請問為何沒有I-M ,D-M的latency？應該有用到吧！這兩個
12/19 21:19, 7F
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