[理工] 計組/交大/pipeline

看板Grad-ProbAsk作者 (94不愛喝水)時間7年前 (2018/12/03 19:30), 編輯推噓3(3推 0噓 27→)
留言30則, 2人參與, 7年前最新討論串1/1
大家晚安 想請問以下下面幾題 1.https://i.imgur.com/Csan39Q.jpg
想問這題的b小題(解答已用黑線框在下面) 看不太懂圖為何這樣畫 我對這lw指令轉換的認知:從Reg file讀出r5後 和30相加再放到r1 之後再把r1內容載到r3 我對這解答圖的認知: 從reg file讀出r1、r5後,r1+r5,同時取出r3內容 之後??? 2.https://i.imgur.com/1nTvOwh.jpg
想問紅色圈起來的部分(解答給都是true) (1).c選項若改成multicycle-cycle implementation，則這選項還會對嗎? (2).d選項和20題的b選項,這裡的clock cycle是指cycle time? 我知道cycle time跟clock cycle不同 而且若是single 則cycle time由最長指令的critical path決定, (若這樣20題b就說得通了) 而multi.的則是最長step決定( 但課本好像沒特別提到clock cycle怎麼決定...? 3.https://i.imgur.com/Tzsy0Rm.jpg
最後這題想問jump指令為何只有用到IF? 在Multicycle machine那裡有寫說jump指令的CPI是3,因為會經過IF,ID,EXE 這3個STAGE嗎 麻煩大家了 謝謝 -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 114.24.211.125 ※ 文章網址: https://www.ptt.cc/bbs/Grad-ProbAsk/M.1543836650.A.4DF.html
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最後一張圖好像不太清楚 這是修過的https://i.imgur.com/
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推
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1的意思是所有lw/sw指令都沒有offset，所以原本有offset
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的必須被拆成"兩個"分開沒有關係的指令，這樣EX跟MEM就沒
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有先後次序關係，可以合併成一個stage
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2多時脈白算盤已經刪除了，張凡的課本在第四章最後面有大
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略提到，就是把原本的single盡量平均切成好幾個部分(MIPS
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切五分)，每個指令只要跑需要用到的部分就好(e.g. R type
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跑IF ID EX WB四個部分就好，所以CPI=4)，如此的cycle ti
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me就是最長步驟時間。其實跟第五章pipeline概念有點像，
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但一次只會有一個指令在跑
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看你的圖片看得好辛苦rrrrr XD
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推
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剛剛沒看清楚2你的問題，我覺得d應該改成single才是對的
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，multi每個指令的cycle都不一樣，而clock cycle的話就如
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你說要找最長的步驟。c的話不太懂他的意思，pipeline本
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來不就是從single來的嗎，single的實作會讓設計pipeline
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更容易(?)
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S大先謝謝你的回覆,我知道第一章圖ex跟mem可在同stage
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我不懂的是為什麼他線是這樣畫 這樣ofsset30是從哪來..?
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最後就是 下次圖會改進 上網抓XD 抱歉 QQ
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推
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他改善之後就沒有offset的問題了
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題目說取消offset的機制，也就是說如果真的要讀offset的
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地址只能先把offset加進暫存器，再去暫存器的地址去記憶
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體讀，這樣就不用在讀記憶體前還要用ALU計算地址，兩個才
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能合併，也因為這樣題目才會說原本的lw/sw要分成那兩個
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指令
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12/04 22:57, 7年前 , 27F
QQ 還是不太懂 所以我可以解讀成DM左邊兩個input
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12/04 23:01, 7年前 , 28F
是..什麼 剛剛原本想打DM左邊input是r1和r3 但是邊看你
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12/04 23:01, 7年前 , 29F
的回應 結果腦袋就deadlock了 XD
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12/04 23:09, 7年前 , 30F
阿阿阿阿阿阿阿我懂了！　感謝你S大(跪
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