討論串[問題] verilog 語法 inout
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io pad的 model 大概是長類似這樣. inout IO;. input I;. ouput O;. input OE;. assign IO = OE ? I : 1'bz; // bufif1 bufif1_inst(IO, I, OE);. assign O = IO; // buf
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雙向 IO 一定要在通訊的portocol做一些BUS 使用權的規定才能使用. 比方說 low pin count 匯流排 他在他的bus cycle上有明確規定何時是. Host 發資料 何時是 slave發資料 並不會兩端同時寫入資料的情形發生. 另外考慮到延遲問題 當兩邊換手時也許有一端的OE
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