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討論串[問題] VHDL
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[問題] VHDL
推噓0(0推 0噓 0→)留言0則，0人參與, 最新作者happy3308 (Johanson)時間14年前 (2011/12/02 12:36), 編輯資訊
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小弟最近在做VHDL想關CODE 假設前端訊號進來經過種種處理之後,. 得到的是CLOCK 數, 由於訊號源不穩定，導致CLOCK 數 是不穩定的,. 在此假設依序得到的五筆800 1000 1100 1200 1300 CLOCK數量,. 請問是否能在VHDL 中 做平均呢?? 希望大家幫忙!!謝
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[問題] VHDL
推噓1(1推 0噓 0→)留言1則，0人參與, 最新作者mepass (mepass)時間18年前 (2008/03/27 00:24), 編輯資訊
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請問process()裡面的訊號有什麼意義嗎. 我目前只知道在下面的敘述式裡會用到. 我看書上的解釋是：當括號內的的訊號被改變時，. 在它底下的所有敘述會立刻. 被由上往下依順序被處理。. 老實說我看不是很懂 而且我發現在括號裡面訊號的順序不同. 執行結果也不一樣 例如：process(a,b) !
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