討論串[問題] 請問一題關於差動的...
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[恕刪]. (借用這篇回) ^^^^^^^^^^^^^^^^^^^^^^^^ ^^^^^^^^^^^^^^^^^^^^^. 其實解答就在這句話. 這裡的channel length modulation已經用ro3,4,5,6表示了. 就不要在想「電流會隨著Vo改變」這件事情了. 因為所有東西的來源
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後來想一想，也不用太在乎i7 i8究竟怎麼流... 反正你已經抓到Gm的電流方向，剩下的就是掛上電阻去並聯就好了... 若是真正要討論i7 i8電流怎麼流，大概要畫小訊號圖才容易瞭解吧... 反正i7 i8也只不過是輸入端提供的電流在分出去流到電阻而已... 後來又看了smith p891那個圖，發
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關於dominant pole, non-dominant pole. 我們來看. 用open circuit的方法. 用T-model(較為方便). 從上往下依序下分析. (1)m4S. Cgs4兩端接地，不需考慮. (2)m6S. Cgs6一端接地. 另一端看到的是ro4//(1/gm6)接地.
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我覺得平常小電流m6和m5應該都是向上的..... 只是在看Gm的時候...因為vo7接地. 故上方的m4 m6 都沒有電流. 只有m8有電流往下 故"流進節點7的電流= -i=io. then vo7= (-i) x Rout , Rout = Roup // Rodown. so Ad=(Vo6
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