[問題] limiting amplifier offset and jitter

看板Electronics作者 (clube)時間11年前 (2015/03/16 10:03), 11年前編輯推噓6(603)
留言9則, 3人參與, 最新討論串1/1
大家好,小弟有個觀念想和大家討論,假設一個limiting amplifier input signal rising time = 210ps/480mV, output rising time = 100ps/480mV, dc gain = 6(v/v), 假設limiting amplifier 的 input referred offset = 10mV, 則output offset = 10mV*6 = 60mV, 則推算input referred offset和 output offset對jitter 的影響量 分別為 4.37ps和 12.5ps, 請問大家這樣算有問題嗎? 還有為何對jitter的影響量從 input 和 output 看會不一樣? 麻煩大家糾正我了,謝謝!! -- ←─人渣 │ ╭─ 01:18AM ←─廢物 │ ┌┴┐ 不班◣◢◢ 好~只剩一筆 ←─沒三小路用 ╲ ↖ │ /\ 開會車▁▂▁_ issue了! ╱/, ←─智障 蠢 \ /│ / ˊ▼ 走已 `◥ ●● ▲◤'> ▊◣ |||噗滋 ←─ ← │ / ╴▼ 了經 \■/◤ ◥ ▊█ -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 60.248.26.247 ※ 文章網址: https://www.ptt.cc/bbs/Electronics/M.1426471398.A.819.html ※ 編輯: Clemens71 (60.248.26.247), 03/16/2015 14:23:46

03/16 23:57, , 1F
你的jitter是哪種jitter?
03/16 23:57, 1F

03/17 00:26, , 2F
回obov大, 是peak to peak jitter
03/17 00:26, 2F

03/18 09:45, , 3F
jitter是random的..offset不應該影響jitter吧
03/18 09:45, 3F

03/18 13:52, , 4F
應該是offset造成的DCD
03/18 13:52, 4F

03/18 13:58, , 5F
從rising time來看in->out 頻寬有掉
03/18 13:58, 5F

03/18 13:59, , 6F
jitter應該是看ouput才對
03/18 13:59, 6F

03/18 14:07, , 7F
仔細推一推又好像看input才對耶
03/18 14:07, 7F

03/18 14:12, , 8F
不過這個數字看起來好討厭 不能用個整數嗎?
03/18 14:12, 8F

03/18 14:33, , 9F
哈 抱歉了obov大
03/18 14:33, 9F
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