[問題] 如何把數位訊號灌進FPGA裡做驗證
我用verilog寫了一個電路
然後把他燒進FPGA裡面 型號是ALTERA DE3
這個電路有18個bits的input 1個clock
還有3bits的output
我把這些PIN腳都接到FPGA的GPIO裡了
請問
我需要一個取樣頻率為48k Hz的18bits輸入訊號
我該如何產生的這訊號然後灌進input裡面
然後如何驗證波形
logic analyzer可以做到嗎
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※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 163.22.18.24
※ 文章網址: http://www.ptt.cc/bbs/Electronics/M.1401785689.A.864.html
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有, 我有想到這一個方法 不過我們實驗是只有一片
要跟其他實驗室的借或是把產生器寫在同一個板子上囧
所以想問問看還有其他方法嗎, 沒有應該就用這個方法了
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input的取樣頻率是48k Hz, 跟裡面的Clock頻率是一樣的
然後18bits是從外部parallel-in的
※ 編輯: ul4ej9 (163.22.18.24), 06/03/2014 19:06:15
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