[問題]tsmc .18 layout問題

看板Electronics作者 (owen)時間12年前 (2012/06/05 16:21), 編輯推噓5(509)
留言14則, 7人參與, 最新討論串1/1
想請問一下因為我現在要打metal_2,所以會打一個Via1 我是依照給的standard cell給的模式去畫,就是metal_1在contact上下左右各留0.08 可是他的standard cell再DRC會過但是我的卻會出下面的問題 metal enclose Via1 at end-of-line or outer corner is 0.1 跟min ME1 region 0.2025 sq.um2 如果我把metal_1拉很大的話就沒這個問題,可是standard cell的size我卻跑不過 麻煩解答一下 謝謝! -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 140.112.251.184

06/05 16:23, , 1F
你如果是"EOL"的via1, 上下左右要各留0.1
06/05 16:23, 1F

06/05 16:24, , 2F
M1最小要是0.45*0.45
06/05 16:24, 2F

06/05 16:36, , 3F
建議m1_m2額外建cell,用呼叫加上去,打via這樣很怪...
06/05 16:36, 3F

06/05 18:07, , 4F
你單獨一個via的DRC不會過 外面的M1最小要有一定的面積
06/05 18:07, 4F

06/05 22:45, , 5F
你若是用laker畫的話,按o應該有現成via可用?
06/05 22:45, 5F

06/06 00:24, , 6F
謝謝!
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06/06 10:02, , 7F
我用點一八製程 按O 叫他建好的 via 來用 DRC 也是面積錯誤
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06/06 11:38, , 8F
想起來了,應該是metal有最小面積限制,要手動去補
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06/06 11:40, , 9F
按o只能確保via到metal的距離正確,但metal最小面積要
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06/06 11:40, , 10F
手動去補足
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06/06 12:20, , 11F
應該是 因為我之前也是手動把 metal 補上去才可以過 XDD
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06/06 13:54, , 12F
via打那麼小 不怕出事嗎 QQ
06/06 13:54, 12F

08/13 19:27, , 13F
你單獨一個via的DR https://noxiv.com
08/13 19:27, 13F

09/17 23:21, , 14F
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文章代碼(AID): #1FpS6KbF (Electronics)