[問題] 用 Design Compiler 合成後之小疑惑

看板Electronics作者 (腦殘沒藥醫)時間15年前 (2011/04/01 12:52), 編輯推噓0(0推 0噓 0→)
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徵求高手幫忙解惑, 如網址內的圖片所示, http://ppt.cc/fjIt 為什麼用 DC synthesis 之後, 我的 d_cpu_in 會有 feedback loop !? 這樣是否會產生什麼問題!? 還是可以不用管它!? 懇請各位高手幫忙... -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 59.124.225.10
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