[問題] Processing Latency
Cell 1 Cell 2
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(4 Clock Cycles) | | C | |
A -------->|(10 Clock Cyles)|---->|(10 Clock Cycles)|
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B D
關於Processing Latency計算的問題一值讓小弟很疑惑。問題是這樣的，在一個System中
，Data A每經過4 clock cycles輸入這個系統中，在Cell 1 必須經過10 clock cycles才
才能將Data C處理好輸出B。同理，Cell 2 必須經過10 clock cycles才能將Data C處理
好輸出D。換句話說，我真正從輸入資料A到完成這筆資料的處理，總共用了20 clock ---
cycles。不過因為Pipeline的設計我們可以每經過4 clock cycles就輸入輸出一筆新資料
，也就是每經過4 clock cycles , A.B.D 都會更新一次。
然而關於這個系統Latency的計算，究竟是4 clock cyles，或是20? (甚至是10?)
會問這個問題的原因主要是因為我在不同的Paper中，他們對於Latency的計算都不相同，
然而他們卻直接拿對方的結果來做比較。希望各位前輩能為我解惑，感激不盡!
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